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文檔簡(jiǎn)介
1、計(jì)算機(jī)學(xué)科專(zhuān)業(yè)基礎(chǔ)綜合組成原理-16(總分:100.00 ,做題時(shí)間:90分鐘)一、單項(xiàng)選擇題(總題數(shù):33,分?jǐn)?shù):66.00).下列各類(lèi)存儲(chǔ)器中,不采用隨機(jī)存取方式的是 。 (分?jǐn)?shù):2.00)A.EPROMB.CD-ROM VC.DRAMD.SRAM解析:解析隨機(jī)存取方式是指 CPIM以對(duì)存儲(chǔ)器的任一存儲(chǔ)單元中的內(nèi)容隨機(jī)存取,而且存取時(shí)間與存儲(chǔ)單元的物理位置無(wú)關(guān)。選項(xiàng) A、O D均采用隨機(jī)存取方式,CDROMP光盤(pán),采用串行存取方式。注意, CD-ROM只讀型光盤(pán)存儲(chǔ)器,其訪問(wèn)方式是順序訪問(wèn),不屬于只讀存儲(chǔ)器(ROM.磁盤(pán)屬于 類(lèi)型的存儲(chǔ)器。(分?jǐn)?shù):2.00)A.隨機(jī)存取存儲(chǔ)器(RAM)B.
2、只讀存儲(chǔ)器(ROM)C.順序存取存儲(chǔ)器(SAM)D.直接存取存儲(chǔ)器(DAM) V解析:解析磁盤(pán)屬于直接存取存儲(chǔ)器,其速度介于隨機(jī)存取存儲(chǔ)器和順序存取存儲(chǔ)器之間,而選項(xiàng)D指的是存取時(shí)間。3.存儲(chǔ)器的存取周期是指。(分?jǐn)?shù):2.00)A.存儲(chǔ)器的讀出時(shí)間B.存儲(chǔ)器的寫(xiě)入時(shí)間C.存儲(chǔ)器進(jìn)行連續(xù)讀或?qū)懖僮魉试S的最短時(shí)間間隔VD.存儲(chǔ)器進(jìn)行一次讀或?qū)懖僮魉璧钠骄鶗r(shí)間解析:解析存取時(shí)間(T a )指從存儲(chǔ)器讀出或者寫(xiě)入一次信息所需要的平均時(shí)間;存取周期(T C )指連續(xù)兩次訪問(wèn)存儲(chǔ)器之間所必需的最短時(shí)間間隔。對(duì)T c 一般有:T c =T a+T r ,其中T r為復(fù)原時(shí)間;對(duì)SRAMW存取信息的穩(wěn)定時(shí)
3、間,對(duì) DRAM旨刷新的又一次存取時(shí)間。.設(shè)機(jī)器字長(zhǎng)為32位,一個(gè)容量為16MB的存儲(chǔ)器,CPU半字尋址,其可尋址的單元數(shù)是 。A.224B.223C.222D.221(分?jǐn)?shù):2.00)V解析:解析16MB=224 B,由于字長(zhǎng)為32位,現(xiàn)在按半字(16位=2B)尋址,故可尋址的單元數(shù)為 2 24 B/2B=2 23。.相聯(lián)存儲(chǔ)器是按 進(jìn)行尋址的存儲(chǔ)器。(分?jǐn)?shù):2.00)A.地址指定方式B.堆棧存儲(chǔ)方式C.內(nèi)容指定方式和堆棧存儲(chǔ)方式相結(jié)合D.內(nèi)容指定方式和地址指定方式相結(jié)合 V解析:解析相聯(lián)存儲(chǔ)器的基本原理是把存儲(chǔ)單元所存內(nèi)容的某一部分作為檢索項(xiàng)(即關(guān)鍵字項(xiàng))去檢索該存儲(chǔ)器,并將存儲(chǔ)器中與該檢
4、索項(xiàng)符合的存儲(chǔ)單元內(nèi)容進(jìn)行讀出或?qū)懭?。所以它是按?nèi)容或地址進(jìn)行尋址 的,價(jià)格較為昂貴。一般用來(lái)制作TLB、相聯(lián)Cache等。.某計(jì)算機(jī)系統(tǒng),其操作系統(tǒng)保存在硬盤(pán)上,其內(nèi)存儲(chǔ)器應(yīng)該采用 。(分?jǐn)?shù):2.00)A.RAMB.ROMC.RA而 ROM VD.都不對(duì)解析:解析操作系統(tǒng)保存在硬盤(pán)上,首先需要將其引導(dǎo)到主存中,而引導(dǎo)程序通常存放在ROW,程序運(yùn)行時(shí)需要進(jìn)行讀寫(xiě)操作,因此應(yīng)采用RAM.在下列幾種存儲(chǔ)器中,CPU不能直接訪問(wèn)的是 。(分?jǐn)?shù):2.00)A.硬盤(pán) V.內(nèi)存C.CacheD.寄存器解析:解析CPU不能直接訪問(wèn)硬盤(pán),需先將硬盤(pán)中的數(shù)據(jù)調(diào)入內(nèi)存才能被CPU所訪問(wèn)。8.若某存儲(chǔ)器存儲(chǔ)周期為
5、250ns,每次讀出16位,則該存儲(chǔ)器的數(shù)據(jù)傳輸率是 。 A.4X106B/s B.4MB/S 6 C.8X10B/SD.8 X 2 20B/s(分?jǐn)?shù):2.00)V解析:解析計(jì)算的是存儲(chǔ)器的帶寬,每個(gè)存儲(chǔ)周期讀出16bit=2B,故而數(shù)據(jù)傳輸率是2B/(250 X10 -9 s), 即 8X 10 6 B/s 。本題中 8MB/s 是 8X 1024X 1024B/S。通常,數(shù)據(jù)傳輸率中的 M指的是10 6而非2 20 , 一般二進(jìn)制表示的 K M僅用于存儲(chǔ)容量相關(guān)計(jì)算。.設(shè)機(jī)器字長(zhǎng)為64位,存儲(chǔ)容量為128MB若按字編址,它可尋址的單元個(gè)數(shù)是 。(分?jǐn)?shù):2.00)A.16MBB.16M VC
6、.32MD.32MB解析:解析機(jī)器字長(zhǎng)位64位,即8B,按字編址,故可尋址的單元個(gè)數(shù)是128MB/8B=16M.計(jì)算機(jī)的存儲(chǔ)器采用分級(jí)方式是為了 。(分?jǐn)?shù):2.00)A.方便編程B.解決容量、速度、價(jià)格三者之間的矛盾VC.保存大量數(shù)據(jù)方便D.操作方便解析:解析存儲(chǔ)器有3個(gè)主要特性:速度、容量和價(jià)格 /位(簡(jiǎn)稱(chēng)位價(jià))。存儲(chǔ)器采用分級(jí)方式是為了解 決這三者之間的矛盾。.計(jì)算機(jī)的存儲(chǔ)系統(tǒng)是指 。(分?jǐn)?shù):2.00) A.RAMB.ROMC.主存儲(chǔ)器D.Cache、主存儲(chǔ)器和外存儲(chǔ)器V解析:解析計(jì)算機(jī)的存儲(chǔ)系統(tǒng)包括 CPU內(nèi)部寄存器、Caches主存和外存。.在多級(jí)存儲(chǔ)彳系中,“ Cache-主存”結(jié)構(gòu)
7、的作用是解決 的問(wèn)題。(分?jǐn)?shù):2.00)A.主存容量不足B.主存與輔存速度不匹配C.輔存與CPU1度不匹配D.主存與CPU1度不匹配V解析:解析Cache中的內(nèi)容只是主存內(nèi)容的部分副本 (拷貝),因而“ Cache-主存”結(jié)構(gòu)并沒(méi)有增加主存容量,是為了解決主存與 CPU速度不匹配的問(wèn)題。.存儲(chǔ)器分層體系結(jié)構(gòu)中,存儲(chǔ)器從速度最快到最慢的排列順序是 。(分?jǐn)?shù):2.00)A.寄存器一主存一Cache一輔存B.寄存器一主存一輔存一CacheC.寄存器一Cache一輔存一主存D.寄存器一Cache一主存一輔存V解析:解析在存儲(chǔ)器分層結(jié)構(gòu)中,寄存器在CPU中,因此速度最快,Cache次之,主存再次之,最慢
8、的是輔存(如磁盤(pán)、光盤(pán)等)。.在Cache和主存構(gòu)成的兩級(jí)存儲(chǔ)體系中,主存與 Cache同時(shí)訪問(wèn),Cache的存取時(shí)間是100ns,主存的 存取時(shí)間是1000ns,如果希望有效(平均)存取時(shí)間不超過(guò) Cache存取時(shí)間的115%則Cache的命中率至少 應(yīng)為。(分?jǐn)?shù):2.00)A.90%B.98%C.95%D.99% V解析:解析假設(shè)命中率為x,則可得到100 x+1000(1- x)98.33%, 因此命中率至少為 99%.下列關(guān)于多級(jí)存儲(chǔ)系統(tǒng)的說(shuō)法中,正確的有 。I .多級(jí)存儲(chǔ)系統(tǒng)是為了降低存儲(chǔ)成本n .虛擬存儲(chǔ)器中主存和輔存之間的數(shù)據(jù)調(diào)動(dòng)對(duì)任何程序員是透明的m. CPU只能與Cache直
9、接交換信息,CPUf主存交換信息也需要經(jīng)過(guò)Cache(分?jǐn)?shù):2.00)A.僅 I VB.僅I和UI、II 和 W.僅 U解析:解析主存和輔存之間的數(shù)據(jù)調(diào)動(dòng)則是由硬件和操作系統(tǒng)共同完成的,僅對(duì)應(yīng)用級(jí)程序員透明。CPU與主存可直接交換信息。.某一 SRAMK片,其容量為1024X8位,除電源和接地端外,該芯片的引腳的最小數(shù)目為(分?jǐn)?shù):2.00)A.21 VB.22C.23D.24解析:解析芯片容量為1024X8位,說(shuō)明芯片容量為1024B,且以字節(jié)為單位存取,也就是說(shuō)地址線數(shù)要10根(1024B=2 10 B)o 8位說(shuō)明數(shù)據(jù)線要8根,加上片選線和讀/寫(xiě)控制線(讀控制為RD寫(xiě)控制為wE), 故而引
10、腳數(shù)最小為10+8+1+2=21根。讀寫(xiě)控制線也可以共用一根,但題中無(wú)20選項(xiàng),做題時(shí)應(yīng)隨機(jī)應(yīng)變。.某存儲(chǔ)器容量為32Kx 16位,則 o(分?jǐn)?shù):2.00)A.地址線為16根,數(shù)據(jù)線為32根B.地址線為32根,數(shù)據(jù)線為16根C.地址線為15根,數(shù)據(jù)線為16根 VD.地址線為15根,數(shù)據(jù)線為32根解析:解析該芯片16位,所以數(shù)據(jù)線為16根,尋址空間32K=2 15 ,所以地址線為15根。18.若RA麗每個(gè)存儲(chǔ)單元為16位,則下面所述正確的是 。(分?jǐn)?shù):2.00)A.地址線是16位B.數(shù)據(jù)線是16位 VC.指令長(zhǎng)度是16位D.以上說(shuō)法都不正確解析:解析地址線只與RAM勺存儲(chǔ)單元個(gè)數(shù)有關(guān),而與存儲(chǔ)單
11、元的字長(zhǎng)無(wú)關(guān)。19.DRAM勺刷新是以 為單位的。(分?jǐn)?shù):2.00)A.存儲(chǔ)單元.行 V.列D.存儲(chǔ)字解析:解析DRAM的刷新按行進(jìn)行。20.動(dòng)態(tài)RA昨用下列哪種刷新方式時(shí),不存在死時(shí)間 。(分?jǐn)?shù):2.00)A.集中刷新B.分散刷新 VC.異步刷新D.都不對(duì)解析:解析集中刷新必然存在死時(shí)間。采用分散刷新時(shí),機(jī)器的存取周期中的一段用來(lái)讀/寫(xiě),另一段用來(lái)刷新,故不存在死時(shí)間,但是存取周期變長(zhǎng)了。異步刷新雖然縮短了死時(shí)間,但死時(shí)間依然存在。21.下面是有關(guān)DRAMf口 SRAMff儲(chǔ)器芯片的敘述:I . DRA惦片的集成度比 SRAMSII . DRA惦片的成本比 SRA扃m. DRA惦片的速度比S
12、RAMIV. DRA惦片工作時(shí)需要刷新,SRAM5片工作時(shí)不需要刷新通常情況下,錯(cuò)誤的是。(分?jǐn)?shù):2.00)I 和 UII 和 W Vw 和 ivI 和 IV解析:解析DRA悵片的集成度高于 SRAM I正確;SRAM5片的速度高于 DRAM HI錯(cuò)誤;可以推出 DRAM 芯片的成本低于SRAIM II錯(cuò)誤;SRAM5片工作時(shí)不需要刷新,DRAMK片工作時(shí)需要刷新,IV正確。22.下列說(shuō)法中,正確的是。(分?jǐn)?shù):2.00)A.半導(dǎo)體RAMB息可讀可寫(xiě),且斷電后仍能保持記憶B.DRAM1易失性 RAM而SRAW的存儲(chǔ)信息是不易失的C.半導(dǎo)體RAM是易失性RAM但只要電源不斷電,所存信息是不丟失的V
13、D.半導(dǎo)體RAM是非易失性的RAM解析:解析RAM屬于易失性半導(dǎo)體,故 A、B、D錯(cuò)誤,SRA除口 DRAM勺區(qū)別在于是否需要?jiǎng)討B(tài)刷新。23.關(guān)于SRAMF口 DRAM下列敘述中正確的是 。(分?jǐn)?shù):2.00)A.通常SRAMK靠電容暫存電荷來(lái)存儲(chǔ)信息,電容上有電荷為1,無(wú)電荷為0B.DRAMK靠雙穩(wěn)態(tài)電路的兩個(gè)穩(wěn)定狀態(tài)來(lái)分別存儲(chǔ)0和1C.SRAM度較慢,但集成度稍高;DRAM1度稍快,但集成度低D.SRAM度較快,但集成度稍低;DRAM1度稍慢,但集成度高V解析:解析SRAMR靠雙穩(wěn)態(tài)電路的兩個(gè)穩(wěn)定狀態(tài)來(lái)分別存儲(chǔ)0和1, A錯(cuò)誤。DRA做靠電容暫存電荷來(lái)存儲(chǔ)信息,電容上有電荷為 1,無(wú)電荷為0
14、, B錯(cuò)誤。SRAM度較快,不需要?jiǎng)討B(tài)刷新,但集成度稍低,功 耗大,單位價(jià)格高;DRAMI成度高,功耗小,單位價(jià)格較低,需定時(shí)刷新,故速度慢,故 C錯(cuò)誤、D正確。24.某一 DRA悵片,采用地址復(fù)用技術(shù),其容量為1024X8位,除電源和接地端外,該芯片的引腳數(shù)最少是(讀寫(xiě)控制線為兩根)。(分?jǐn)?shù):2.00)A.16B.17 VC.19D.21解析:解析1024X8位,故可尋址范圍是1024=2 10 B,按字節(jié)尋址。而采用地址復(fù)用技術(shù),通過(guò)行通選和列通選分行列兩次傳送地址信號(hào),故而地址線減半為5根,數(shù)據(jù)線仍為8根;加上行通選和列通選以及讀/寫(xiě)控制線(片選線用行通選代替)4根,總共是17根。注意S
15、RA除口 DRAM勺區(qū)別,DRAM!采用地址復(fù)用技術(shù)的,而 SRAM是。.某容量為256MB的存儲(chǔ)器由若干4MX8位的DRA惦片構(gòu)成,該DRA惦片的地址引腳和數(shù)據(jù)引腳總數(shù)是(分?jǐn)?shù):2.00)A.19 VB.22C.30D.36解析:解析4MX8位的芯片數(shù)據(jù)線應(yīng)為 8根,地址線應(yīng)為log 2 4M=22根,而DRA味用地址復(fù)用技術(shù), 地址線是原來(lái)的1/2 ,且地址信號(hào)分行、列兩次傳送。地址線數(shù)為 22/2=11根,所以地址引腳與數(shù)據(jù)引腳 的總數(shù)為11+8=19根,選A此題需要注意的是 DRAM!采用傳兩次地址的策略, 所以地址線為正常的一半, 這是很多考生容易忽略的地方。.下列有關(guān)RAMB RO
16、M勺敘述中,正確的是 oI . RAM1易失性存儲(chǔ)器,ROMt非易失性存儲(chǔ)器II . RAMF口 RO幽是采用隨機(jī)存取的方式進(jìn)行信息訪問(wèn)m . RAMF口 ROMtB可用做 CacheIV . RAMF口 ROMtB需要進(jìn)行刷新(分?jǐn)?shù):2.00)A.僅I和U VB.僅II和WC.僅 I、II 和 wD.僅 U、HI 和 IV解析:解析一般Cache采用高速的SRAMK作,比RO遍度快很多,因此W是錯(cuò)誤的。動(dòng)態(tài)RAM需要刷新,而ROM需要刷新,故IV錯(cuò)誤。27.下列關(guān)于閃存(Flash Memory)的敘述中,錯(cuò)誤的是 。(分?jǐn)?shù):2.00)A.信息可讀可寫(xiě),并且讀、寫(xiě)速度一樣快VB.存儲(chǔ)元由MO
17、S1組成,是一種半導(dǎo)體存儲(chǔ)器C.掉電后信息不丟失,是一種非易失性存儲(chǔ)器D.采用隨機(jī)訪問(wèn)方式,可替代計(jì)算機(jī)外部存儲(chǔ)器解析:解析閃存是EEPROM1進(jìn)一步發(fā)展,可讀可寫(xiě),用MOS1的浮柵上有無(wú)電荷來(lái)存儲(chǔ)信息。閃存依然是ROM勺一種,寫(xiě)入時(shí)必須先擦除原有數(shù)據(jù),故寫(xiě)速度比讀速度要慢不少(硬件常識(shí))。閃存是一種非易失性存儲(chǔ)器,它采用隨機(jī)訪問(wèn)方式?,F(xiàn)在常見(jiàn)的SSD固態(tài)硬盤(pán),即由Flash芯片組成。.下列幾種存儲(chǔ)器中,是易失性存儲(chǔ)器。(分?jǐn)?shù):2.00)A.Cache VB.EPROMC.Flash MemoryD.CD-ROM解析:解析Cache由SRAMS成,掉電后信息即消失,屬于易失性存儲(chǔ)器。.U盤(pán)屬于
18、 類(lèi)型的存儲(chǔ)器。(分?jǐn)?shù):2.00)A.高速緩存B.主存C.只讀存儲(chǔ)器VD.隨機(jī)存取存儲(chǔ)器解析:解析U盤(pán)采用Flash Memory技術(shù),它是在EEPROM1基礎(chǔ)上發(fā)展起來(lái)的,屬于ROM勺一種。由于擦寫(xiě)速度和性?xún)r(jià)比均很可觀,故而其常??捎米鲚o存。隨機(jī)存取與隨機(jī)存取存儲(chǔ)器 (Random Access Memory , RAM是不同的,只讀存儲(chǔ)器(ROM也是隨機(jī)存取的。 因此,支持隨機(jī)存取的存儲(chǔ)器并不一定是隨機(jī)存取存儲(chǔ)器。.某計(jì)算機(jī)系統(tǒng),其操作系統(tǒng)保存于硬盤(pán)上,其內(nèi)存儲(chǔ)器應(yīng)該采用 。(分?jǐn)?shù):2.00)A.RAMB.ROMC.RA而 ROM VD.均不完善解析:解析因計(jì)算機(jī)的操作系統(tǒng)保存于硬盤(pán)上,所
19、以需要BIOS的引導(dǎo)程序?qū)⒉僮飨到y(tǒng)引導(dǎo)到主存 (RAM)中,而引導(dǎo)程序則固化于 ROW。.下列說(shuō)法正確的是。(分?jǐn)?shù):2.00)A.EPRO限可改寫(xiě)的,故而可以作為隨機(jī)存儲(chǔ)器B.EPRO限可改寫(xiě)的,但不能作為隨機(jī)存儲(chǔ)器VC.EPROM!不可改寫(xiě)的,故而不能作為隨機(jī)存儲(chǔ)器D.EPROW能改寫(xiě)一次,故而不能作為隨機(jī)存儲(chǔ)器解析:解析EPROM可多次改寫(xiě),但改寫(xiě)較為繁瑣,寫(xiě)入時(shí)間過(guò)長(zhǎng),且改寫(xiě)的次數(shù)有限,且速度較慢,因 此不能作為需要頻繁讀寫(xiě)的RAM使用。.下列哪些是動(dòng)態(tài)半導(dǎo)體存儲(chǔ)器的特點(diǎn) 。I .在工作中存儲(chǔ)器內(nèi)容會(huì)產(chǎn)生變化U.每隔一定時(shí)間,需要根據(jù)原存內(nèi)容重新寫(xiě)入一遍m. 一次完整的刷新過(guò)程需要占用兩
20、個(gè)存儲(chǔ)周期IV. 一次完整的刷新過(guò)程只需要占用一個(gè)存儲(chǔ)周期(分?jǐn)?shù):2.00)I、WU、WU、IV VD.只有W解析:解析動(dòng)態(tài)半導(dǎo)體存儲(chǔ)器是利用電容存儲(chǔ)電荷的特性記錄信息,由于電容會(huì)放電,必須在電荷流失 前對(duì)電容充電,即刷新。方法是每隔一定時(shí)間,根據(jù)原存內(nèi)容重新寫(xiě)入一遍,故I錯(cuò)誤。這里的讀并不是 把信息讀入CPU存也不是從CPU向主存存入信息,它只是把信息讀出,通過(guò)一個(gè)刷新放大器后又重新存 回到存儲(chǔ)單元里去,而刷新放大器是集成在RAM上的。因此,這里只進(jìn)行了一次訪存,也就是占用一個(gè)存取周期,u、iv正確,w錯(cuò)誤。.下列存儲(chǔ)器中,在工作期間需要周期性刷新的是 。(分?jǐn)?shù):2.00)A.SRAMB.S
21、DRAM VC.ROMD.FLASH解析:解析DRAM使用電容存儲(chǔ),所以必須隔一段時(shí)間刷新一次,如果存儲(chǔ)單元沒(méi)有被刷新,存儲(chǔ)的信 息就會(huì)丟失。SDRAMI示同步動(dòng)態(tài)隨機(jī)存儲(chǔ)器。二、綜合應(yīng)用題(總題數(shù):4,分?jǐn)?shù):34.00).某個(gè)兩級(jí)存儲(chǔ)器系統(tǒng)的平均訪問(wèn)時(shí)間為12ns,該存儲(chǔ)器系統(tǒng)中頂層存儲(chǔ)器的命中率為90%訪問(wèn)時(shí)間是5ns,問(wèn):該存儲(chǔ)器系統(tǒng)中底層存儲(chǔ)器的訪問(wèn)時(shí)間是多少(假設(shè)采用同時(shí)訪問(wèn)兩層存儲(chǔ)器的方式)?(分?jǐn)?shù):4.00) 正確答案:()解析:設(shè)底層存儲(chǔ)器訪問(wèn)時(shí)間為T(mén),則有12ns=(0.90 x5ns)+(0.10 XT)求得 T=75ns。CPUa行一段程序時(shí),Cache完成存取的次數(shù)為1
22、900次,主存完成存取的次數(shù)為100次,已知Cache存取周期為50ns ,主存存取周期為 250ns。設(shè)主存與Cache同時(shí)訪問(wèn),試問(wèn):(分?jǐn)?shù): 10.00).Cache/主存系統(tǒng)的效率。(分?jǐn)?shù): 5.00)正確答案:()解析:命中率 H=N c/(N c +N m )=1900/(1900+100)=0.95主存訪問(wèn)時(shí)間與 Cache訪問(wèn)時(shí)間的倍率:r=T m /T c =250ns/50ns=5Cache主存系統(tǒng)的效率:e=5問(wèn)Cache的時(shí)間/平均訪存時(shí)間訪問(wèn)效率:e=1/H+(1-H)r=1/0.95+(1-0.95)*5=83.3%(2).平均訪問(wèn)時(shí)間。(分?jǐn)?shù):5.00)正確答案:()解析:平均訪問(wèn)時(shí)間: T a =T c /e=50ns/0.833=60ns在顯示適配器中,用于存放顯示信息的存儲(chǔ)器稱(chēng)為刷新存儲(chǔ)器,它的重要性能指標(biāo)是帶寬。具體工作中,顯示適配器的多個(gè)功能部分要爭(zhēng)用刷新存儲(chǔ)器
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