課程設(shè)計報告

課程設(shè)計報告課程名稱數(shù)字邏輯課程設(shè)計課題任務(wù)一10線-4線優(yōu)先編碼器的設(shè)計課題任務(wù)二T觸發(fā)器的設(shè)計專業(yè)網(wǎng)絡(luò)工程班級學(xué)號姓名指導(dǎo)教師劉洞波陳華光陳多2015年12月31日

課程設(shè)計任務(wù)書課程名稱數(shù)字邏輯課程設(shè)計課題任務(wù)一10-4線優(yōu)先編碼器課題任務(wù)二T觸發(fā)器的設(shè)計專業(yè)班級網(wǎng)絡(luò)工程學(xué)生姓名學(xué)號指導(dǎo)老師劉洞波陳華光陳多審批任務(wù)書下達(dá)日期：2015年12月14日任務(wù)完成日期：2015年12月31日一、設(shè)計內(nèi)容與設(shè)計要求1．設(shè)計內(nèi)容：本課程是一門專業(yè)實(shí)踐課程，學(xué)生必修的課程。其目的和作用是使學(xué)生能將已學(xué)過的數(shù)字電子系統(tǒng)設(shè)計、VHDL程序設(shè)計等知識綜合運(yùn)用于電子系統(tǒng)的設(shè)計中，掌握運(yùn)用VHDL或者VerilogHDL設(shè)計電子系統(tǒng)的流程和方法，采用QuartusII等工具獨(dú)立應(yīng)該完成2個設(shè)計題目的設(shè)計、仿真與測試。加強(qiáng)和培養(yǎng)學(xué)生對電子系統(tǒng)的設(shè)計能力,培養(yǎng)學(xué)生理論聯(lián)系實(shí)際的設(shè)計思想，訓(xùn)練學(xué)生綜合運(yùn)用數(shù)字邏輯課程的理論知識的能力，訓(xùn)練學(xué)生應(yīng)用QuartusII進(jìn)行實(shí)際數(shù)字系統(tǒng)設(shè)計與驗證工作的能力，同時訓(xùn)練學(xué)生進(jìn)行芯片編程和硬件試驗的能力。任務(wù)一：組合電路設(shè)計課題題目題目一4線-16線譯碼器電路設(shè)計；題目二16選1選擇器電路設(shè)計；題目三4位輸入數(shù)據(jù)的一般數(shù)值比較器電路設(shè)計題目四10線-4線優(yōu)先編碼器的設(shè)計題目五8位全加器的設(shè)計任務(wù)二：時序電路設(shè)計課題題目題目一RS觸發(fā)器的設(shè)計；題目二JK觸發(fā)器的設(shè)計；題目三D觸發(fā)器的設(shè)計；題目四T觸發(fā)器的設(shè)計；題目五十進(jìn)制同步計數(shù)器的設(shè)計；每位同學(xué)根據(jù)自己學(xué)號除以5所得的余數(shù)加一，在任務(wù)一和任務(wù)二中同時選擇相應(yīng)題號的課題。2個任務(wù)獨(dú)立完成對應(yīng)“功能描述”、“詳細(xì)設(shè)計”部分，共用封面、封二、成績評分表和封底，裝訂成一冊。參考書目1

EDA技術(shù)與VHDL程序開發(fā)基礎(chǔ)教程雷伏容,李俊,尹霞

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VHDL電路設(shè)計技術(shù)王道憲賀名臣_x001D_劉偉

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VHDL實(shí)用技術(shù)潘松,王國棟

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VHDL語言100例詳解北京理工大學(xué)ASIC研究所

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VHDL電路設(shè)計雷伏容

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TN702/1852．設(shè)計要求：課程設(shè)計報告規(guī)范課程設(shè)計報告應(yīng)包含如下幾個部分1)功能描述說明設(shè)計器件的功能，包括真值表（功能表），函數(shù)表達(dá)式，邏輯電路圖2)詳細(xì)設(shè)計按照VHDL語言開發(fā)流程寫出整個開發(fā)過程，可以根據(jù)如下步驟適當(dāng)導(dǎo)出程序，程序界面截圖到課程設(shè)計報告對應(yīng)模塊。3)調(diào)試分析以及設(shè)計體會a.仿真或程序下載調(diào)試（附界面截圖）。b.設(shè)計過程中遇到的問題以及解決問題的方法。c.課程設(shè)計過程經(jīng)驗教訓(xùn)、心得體會。4)書寫格式見附帶說明。5)附錄a.參考書目b.源程序清單（帶注釋）●考核方式指導(dǎo)老師負(fù)責(zé)驗收程序的運(yùn)行結(jié)果，并結(jié)合學(xué)生的工作態(tài)度、實(shí)際動手能力、創(chuàng)新精神和設(shè)計報告等進(jìn)行綜合考評，并按優(yōu)秀、良好、中等、及格和不及格五個等級給出每位同學(xué)的課程設(shè)計成績。具體考核標(biāo)準(zhǔn)包含以下幾個部分：平時出勤（占10%）系統(tǒng)需求分析、功能設(shè)計、數(shù)據(jù)結(jié)構(gòu)設(shè)計及程序總體結(jié)構(gòu)合理與否（占10%）程序能否完整、準(zhǔn)確地運(yùn)行，個人能否獨(dú)立、熟練地調(diào)試程序（占40%）設(shè)計報告（占30%）注意：不得抄襲他人的報告（或給他人抄襲），一旦發(fā)現(xiàn)，成績?yōu)榱惴?。?dú)立完成情況（占10%）。課程設(shè)計驗收要求運(yùn)行所設(shè)計的系統(tǒng)。回答有關(guān)問題。提交課程設(shè)計報告紙質(zhì)稿。提交源程序或設(shè)計報告文檔電子稿。依內(nèi)容的創(chuàng)新程度，完善程序情況及對程序講解情況打分。二、進(jìn)度安排上機(jī)時間：十六周周四14:00-18:00十七周周二8:00-12:00、14:00-18:00十七周周四8:00-12:00十七周周五8:00-12:00十八周周二14:00-18:00（交報告）附帶說明：課程設(shè)計報告裝訂順序：封面、任務(wù)書、目錄、正文、評分、附件（程序清單）。正文的格式:一級標(biāo)題用3號黑體,二級標(biāo)題用四號宋體加粗,正文用小四號宋體;行距為22。正文的內(nèi)容:一、課題的主要功能；二、詳細(xì)設(shè)計；三、程序調(diào)試；四、總結(jié)；五、附件（所有程序的原代碼，要求對程序?qū)懗霰匾淖⑨專?個任務(wù)獨(dú)立完成對應(yīng)報告，共用封面、封底，裝訂成一冊。正文總字?jǐn)?shù)要求在5000字以上（不含程序原代碼）。目錄一、10-4線優(yōu)先編碼器的功能1.1函數(shù)表達(dá)式1.2函數(shù)真值表1.3邏輯電路圖二、詳細(xì)設(shè)計2.1創(chuàng)建項目2.2VHDL文本設(shè)計語言輸入2.3編譯功能界面2.4編譯成功三、程序調(diào)試3.1進(jìn)入波形仿真功能3.2給定輸入信號3.3生成波形圖四、總結(jié)五、附件5.1參考書目5.2源程序代碼一、10-4線優(yōu)先編碼器的主要功能1.110線-4線優(yōu)先編碼器的功能是把輸入端代表“0”~“9”這10個數(shù)字編成BCD碼，并且具有優(yōu)先編碼功能，即只對其中優(yōu)先級別最高的信號進(jìn)行編碼。優(yōu)先級別高的編碼器信號排斥級別低的。它需要編碼的10個輸入信號：I0~I9，輸出4位2進(jìn)制代碼：Y3、Y2、Y1、Y0。其輸出函數(shù)表達(dá)式為：Y3=I9+I8=I9+I8；Y2=EQ\*jc0\*"Font:宋體"\*hps14\o\ad(\s\up13(——),I8)I7+EQ\*jc0\*"Font:宋體"\*hps14\o\ad(\s\up13(——),I8)I6+EQ\*jc0\*"Font:宋體"\*hps14\o\ad(\s\up13(——),I8)I5+EQ\*jc0\*"Font:宋體"\*hps14\o\ad(\s\up13(——),I8)I4；Y1=EQ\*jc0\*"Font:宋體"\*hps14\o\ad(\s\up13(——),I8)I7+EQ\*jc0\*"Font:宋體"\*hps14\o\ad(\s\up13(——),I8)I6+EQ\*jc0\*"Font:宋體"\*hps14\o\ad(\s\up13(——),I8)EQ\*jc0\*"Font:宋體"\*hps14\o\ad(\s\up13(——),I5)EQ\*jc0\*"Font:宋體"\*hps14\o\ad(\s\up13(——),I4)I3+EQ\*jc0\*"Font:宋體"\*hps14\o\ad(\s\up13(——),I8)EQ\*jc0\*"Font:宋體"\*hps14\o\ad(\s\up13(——),I5)EQ\*jc0\*"Font:宋體"\*hps14\o\ad(\s\up13(——),I4)I2；Y0=I9+EQ\*jc0\*"Font:宋體"\*hps14\o\ad(\s\up13(——),I8)I7+EQ\*jc0\*"Font:宋體"\*hps14\o\ad(\s\up13(——),I8)EQ\*jc0\*"Font:宋體"\*hps14\o\ad(\s\up13(——),I6)I5+EQ\*jc0\*"Font:宋體"\*hps14\o\ad(\s\up13(——),I8)EQ\*jc0\*"Font:宋體"\*hps14\o\ad(\s\up13(——),I6)EQ\*jc0\*"Font:宋體"\*hps14\o\ad(\s\up13(——),I4)I3+EQ\*jc0\*"Font:宋體"\*hps14\o\ad(\s\up13(——),I8)EQ\*jc0\*"Font:宋體"\*hps14\o\ad(\s\up13(——),I6)EQ\*jc0\*"Font:宋體"\*hps14\o\ad(\s\up13(——),I4)EQ\*jc0\*"Font:宋體"\*hps14\o\ad(\s\up13(——),I2)I1；1.2真值表：I9I8I7I6I5I4I3I2I1I0Y3Y2Y1Y01XXXXXXXXX100101XXXXXXXX1000001XXXXXXX01110001XXXXXX011000001XXXXX0101000001XXXX01000000001XXX001100000001XX0010000000001X00011.3邏輯電路圖二、詳細(xì)設(shè)計2.1創(chuàng)建項目2.2VHDL文本設(shè)計語言輸入2.3編譯功能界面2.4編譯成功三、程序功能調(diào)試3.1進(jìn)入波形仿真功能3.2給定輸入信號3.3生成波形圖一、T觸發(fā)器的功能1.1函數(shù)表達(dá)式1.2函數(shù)真值表1.3邏輯電路圖二、詳細(xì)設(shè)計2.1創(chuàng)建項目2.2VHDL文本設(shè)計語言輸入2.3編譯功能界面2.4編譯成功三、程序調(diào)試3.1進(jìn)入波形仿真功能3.2給定輸入信號3.3生成波形圖四、總結(jié)五、附件5.1參考書目5.2源程序代碼一、T觸發(fā)器的功能T觸發(fā)器的特征方程Qn+1=T+Qn，T=0時，時鐘信號到達(dá)后狀態(tài)保持不變；T=1時每來一個時鐘信號它的狀態(tài)就會翻轉(zhuǎn)一次，具有翻轉(zhuǎn)功能。在數(shù)電中常用來構(gòu)成計數(shù)器。1.1：函數(shù)表達(dá)式Qn+1=T+Qn1.2：函數(shù)真值表TQn+10Qn11.3：邏輯電路圖二、詳細(xì)設(shè)計2.1創(chuàng)建項目2.2VHDL文本設(shè)計語言輸入2.3編譯功能界面2.4編譯成功三、程序功能調(diào)試3.1進(jìn)入波形仿真功能3.2給定輸入信號3.3生成波形圖四：總結(jié)一周的課程設(shè)計結(jié)束了，在這次課程設(shè)計中檢驗了我平時學(xué)習(xí)的知識，在這一周中發(fā)現(xiàn)自己有很多知識還不能融會貫通，但是在設(shè)計過程中，讓我學(xué)會了合作學(xué)會了與他人相處。程設(shè)計是我們專業(yè)課程知識綜合應(yīng)用的實(shí)踐訓(xùn)練，是我們邁向社會，從事職業(yè)工作前一個必不可少的過程，“千里之行始于足下”，通過這次課程設(shè)計，我深深體會了這句話。在這次設(shè)計中遇到了很多實(shí)際性的問題，在實(shí)際設(shè)計中才發(fā)現(xiàn)，書本上理論性的東西與在實(shí)際運(yùn)用中的還是有一定的出入的，所以有些問題不但要深入地理解，而且要不斷地更正以前的錯誤思維。一切問題必須要靠自己一點(diǎn)一滴的解決，而在解決的過程當(dāng)中你會發(fā)現(xiàn)自己在飛速的提升。對于教材管理系統(tǒng)，其程序是比較簡單的，主要是解決程序設(shè)計中的問題，而程序設(shè)計是一個很靈活的東西，它反映了你解決問題的邏輯思維和創(chuàng)新能力，它才是一個設(shè)計的靈魂所在。因此在整個設(shè)計過程中大部分時間是用在程序上面的。很多子程序是可以借鑒書本上的，但怎樣銜接各個子程序才是關(guān)鍵的問題所在，這需要對系統(tǒng)的結(jié)構(gòu)很熟悉。因此可以說系統(tǒng)的設(shè)計是軟件和硬件的結(jié)合，二者是密不可分的。通過這次課程設(shè)計我也發(fā)現(xiàn)了自身存在的不足之處，雖然感覺理論上已經(jīng)掌握，但在運(yùn)用到實(shí)踐的過程中仍有意想不到的困惑，經(jīng)過一番努力才得以解決。

這也激發(fā)了我今后努力學(xué)習(xí)的興趣，我想這將對我以后的學(xué)習(xí)產(chǎn)生積極的影響。其次，這次課程設(shè)計讓我充分認(rèn)識到團(tuán)隊合作的重要性，只有分工協(xié)作才能保證整個項目的有條不絮。另外在課程設(shè)計的過程中，當(dāng)我們碰到不明白的問題時，指導(dǎo)老師總是耐心的講解，給我們的設(shè)計以極大的幫助，使我們獲益匪淺。通過這次設(shè)計，我懂得了學(xué)習(xí)的重要性，了解到理論知識與實(shí)踐相結(jié)合的重要意義，學(xué)會了堅持、耐心和努力，這轉(zhuǎn)載自讀后感將為自己今后的學(xué)習(xí)和工作做出了最好的榜樣。我覺得作為一名軟件工程專業(yè)的學(xué)生，這次課程設(shè)計是很有意義的。更重要的是如何把自己平時所學(xué)的東西應(yīng)用到實(shí)際中。雖然自己對于這門課懂的并不多，很多基礎(chǔ)的東西都還沒有很好的掌握，覺得很難，也沒有很有效的辦法通過自身去理解，但是靠著這一個多禮拜的“學(xué)習(xí)”，在小組同學(xué)的幫助和講解下，漸漸對這門課逐漸產(chǎn)生了些許的興趣，自己開始主動學(xué)習(xí)并逐步從基礎(chǔ)慢慢開始弄懂它。計算機(jī)與通信學(xué)院課程設(shè)計評分表課題名稱：任務(wù)一10-4線優(yōu)先編碼器任務(wù)二T觸發(fā)器的設(shè)計項目評價設(shè)計方案的合理性與創(chuàng)造性設(shè)計與調(diào)試結(jié)果設(shè)計說明書的質(zhì)量答辯陳述與回答問題情況課程設(shè)計周表現(xiàn)情況綜合成績教師簽名：日期：五：附錄5.1：參考書目1

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VHDL程序設(shè)計教程邢建平_x001D_曾繁泰

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VHDL電路設(shè)計雷伏容

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TN702/1855.2：T觸發(fā)器的源代碼LIBRARYIEEE;USEIEEE.STD_LOGIC_1164.ALL;ENTITYcdff1IS PORT(t:INSTD_LOGIC;/輸入cp:INSTD_LOGIC;/時針q:OUTSTD_LOGIC;/輸出qnot:OUTSTD_LOGIC);ENDcdff1;ARCHITECTUREdataflowOFcdff1ISSIGNALq_temp:std_logic;BEGINPROCESS(cp)BEGINIF(cp'EVENTANDcp='1')THEN/當(dāng)時針存在并為時/IF(t='1')THENq_temp<=NOTq_temp;/進(jìn)行翻轉(zhuǎn)/ELSEq_temp<=q_temp;ENDIF;ENDIF;ENDPROCESS;q<=q_temp;qnot<=NOTq_temp;ENDdataflow;5.3：10-4線優(yōu)先編碼器源代碼LIBRARYIEEE;USEIEEE.STD_LOGIC_1164.ALL;ENTITYcypriority_encoderIS PORT( datain:INSTD_LO