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文檔簡介

實訓2：三人表決器設計（基于FPGA）專業(yè)應用電子技術教育班級電教1521姓名祝榮學號1519092102實訓任務：利用美國Altera公司的FPGA芯片和開發(fā)軟件QuartusII，設計三人表決器電路，并完成軟件仿真和硬件驗證。實訓目的：1、強化數(shù)字電路設計方法；2、掌握QuartusII的FPGA設計流程。一、三人表決器電路設計1、三人表決器功能

表決器（voter），是一種代表投票或舉手表決的表決裝置。表決時，與會的有關人員只要按動各自表決器上“贊成”或“反對”的按鈕，熒光屏上即顯示出表決結果。A、B、C3人表決，“1”表示“贊成”，“0”表示“反對”，若有2人或以上人數(shù)贊成，則輸出端Y為“1”表示“通過”，否則Y為“0”表示“不通過”。2、真值表輸入端輸出端ABCY000000100100011110001011110111113、根據真值表畫卡諾圖BC

A000111100001010111根據卡諾圖寫出邏輯表達式L=AB+BC+AC5、根據邏輯表達式畫出邏輯圖電路端口鎖定的芯片引腳APIN_27BPIN_28CPIN_29YPIN_91二、使用QuartusII實現(xiàn)三人表決器1、建立工作庫文件夾voter32、用向導創(chuàng)建工程：File→NewPrejectWizard3、新建原理圖源文件;File→New→BlockDiagram/SchematicFile4、繪制三人表決器電路5、編譯工程6、編輯引腳7、器件編程，寫出方法及遇到的問題1）.連接USB-Blaster到計算機與開發(fā)板2）.將開發(fā)板插上電源3）.查看電腦的驅動是否正常安裝4）.選擇工具欄中Tools中的programmer，下載方式為JTAG，將USB-Blaster添加到下載器硬件5）.將文件添加到編程文件，下載編程8、硬件功能驗證撥碼開關SW0撥碼開關SW1撥碼

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