集成電路設(shè)計(jì)（第4版） 課件 8-4-2 抗干擾設(shè)計(jì)_第1頁
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1第8章

集成電路版圖設(shè)計(jì)與工具28.4版圖設(shè)計(jì)準(zhǔn)則

(‘Rule’forperformance)8.4.1匹配設(shè)計(jì)8.4.2抗干擾設(shè)計(jì)8.4.3寄生的優(yōu)化設(shè)計(jì)8.4.4可靠性設(shè)計(jì)3抗干擾設(shè)計(jì)數(shù)?；旌想娐返陌鎴D布局屏蔽濾波4抗干擾設(shè)計(jì)數(shù)?；旌霞呻娐分械陌鎴D布局模擬和數(shù)字電源地的分離模擬電路和數(shù)字電路、模擬總線和數(shù)字總線盡量分開而不交叉混合

根據(jù)各模擬單元的重要程度，決定其與數(shù)字部分的間距的大小次序

AnalogPowerDigitalPowerDigitalAnalog5抗干擾設(shè)計(jì)電容的屏蔽電路中的高阻接點(diǎn)接上極板，以減小寄生和屏蔽干擾；電容下面用接地的阱來屏蔽襯底噪聲CAP此地應(yīng)為“干凈”地！可獨(dú)立接出，不與其他電路共享6抗干擾設(shè)計(jì)敏感信號(hào)線的屏蔽增大線間距周圍放置地線7抗干擾設(shè)計(jì)敏感信號(hào)線的屏蔽包圍屏蔽缺點(diǎn)：到地的寄生電容較大；加大了布線的難度8抗干擾設(shè)計(jì)敏感電路的屏蔽用接地的保護(hù)環(huán)(guardring)保護(hù)環(huán)應(yīng)接“干凈”的地N阱較深，接地后可用來做隔離PdiffNwell9抗干擾設(shè)計(jì)加濾波電容電源線上和版圖空余地方可填加MOS電容進(jìn)行電源濾波對(duì)模擬電路中的偏置電壓和參考電壓加多晶電容進(jìn)行濾波偏置參考10抗干擾設(shè)計(jì)加濾波電容電源線上和版圖空余地方可填加MOS電容進(jìn)行電源濾波對(duì)模擬電路中的偏

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