

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

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文檔簡介
數(shù)據(jù)選擇器和譯碼器
制作教師:高翔12/5/20231一.實驗?zāi)康?.掌握數(shù)據(jù)選擇器、譯碼器等中規(guī)模數(shù)字集成器件的邏輯功能。2.掌握數(shù)據(jù)選擇器、譯碼器的應(yīng)用。12/5/20232二.實驗原理
1.數(shù)據(jù)選擇器
1)基本功能:從多個輸入數(shù)據(jù)中選擇一個作為輸出。例:雙四選一數(shù)據(jù)選擇器74LS153
D0~D3是四個數(shù)據(jù)輸入端,
A0、A1是選擇輸入端(或稱地址輸入端);
ST是使能端,低電平有效。
使能輸入數(shù)據(jù)輸入選擇輸入輸出12/5/202330001101174LS153邏輯符號及功能表0選通選擇輸入數(shù)據(jù)輸入輸出A1A0D0D1D2D3Y1××××××00000×××00001×××1001×0××0001×1××1010××0×0010××1×1011×××00011×××11由數(shù)據(jù)選擇器的功能表可以看出,輸出Y的邏輯表達(dá)式為:當(dāng),即ST=1,則
數(shù)據(jù)輸入數(shù)據(jù)輸出選擇輸入二.實驗原理12/5/202342)用數(shù)據(jù)選擇器設(shè)計組合邏輯電路例:用雙四選一數(shù)據(jù)選擇器74LS153構(gòu)成一位全加器設(shè)計思路:①寫出全加器的真值表②由真值表寫出全加器的邏輯表達(dá)式③將全加器邏輯表達(dá)式與74LS153邏輯表達(dá)式進(jìn)行數(shù)據(jù)替換④根據(jù)替換后的結(jié)果接線二.實驗原理12/5/20235輸入輸出AiBiCi―1SiCi0000000110010100110110010101011100111111將上式與4選數(shù)據(jù)選擇器的輸出表達(dá)式相比較,可令數(shù)據(jù)選擇器的輸入A1=Ai,A0=Bi,1D0=1D3=Ci―1,1D1=1D2=Ci-1,2D0=0,2D1=2D2=Ci―1,2D3=1,則1Y
=Si,2Y=Ci。①②③二.實驗原理12/5/20236用數(shù)據(jù)選擇器實現(xiàn)全加器邏輯電路圖:指示燈指示燈數(shù)據(jù)開關(guān)數(shù)據(jù)開關(guān)數(shù)據(jù)開關(guān)二.實驗原理12/5/20237例:3—8線譯碼器74LS138
是三個使能端,高電平有效,低電平有效,是三個選擇輸入端,是八個輸出端。74LS138的輸出實際上是地址輸入變量的全部最小項的反函數(shù),即,,
……。2.譯碼器1)基本功能:將二進(jìn)制代碼譯成對應(yīng)的輸出信號。二.實驗原理12/5/2023874LS138功能表:
輸入輸出使能選擇
A2A1
A0
Y0Y1Y2Y3Y4
Y5Y6Y7×1×××
11111111
0××××
1111111110000
0111111110001
1011111110010
1101111110011
1110111110100
1111011110101
1111101110110
1111110110111
11111110二.實驗原理12/5/202392)用譯碼器設(shè)計組合邏輯電路例:用74LS138和與非門設(shè)計一個全加器設(shè)計思路:①寫出全加器的真值表②有真值表寫出全加器的邏輯表達(dá)式③觀察本位和Si和進(jìn)位Ci分別由哪幾個最小項之和組成,與譯碼器輸出相對應(yīng)④根據(jù)上面的結(jié)果接線二.實驗原理12/5/202310全加器的邏輯表達(dá)式:譯碼器輸出代碼令,以為例:
即:同理可得:
二.實驗原理12/5/202311用74LS138和74LS20組成全加器邏輯電路圖:數(shù)據(jù)開關(guān)指示燈指示燈74L.實驗原理12/5/202312三.實驗內(nèi)容
1.驗證數(shù)據(jù)選擇器74LS153的邏輯功能
按圖2.4.1將數(shù)據(jù)選擇器地址端A1、A0接邏輯開關(guān),使能端接地,數(shù)據(jù)輸入端D0~D3接邏輯開關(guān),輸出端接指示燈,接通直流電源后按表2.4.1驗證數(shù)據(jù)選擇器的邏輯功能,列出真值表。
要求在電路圖中自行標(biāo)出引腳號。12/5/202313
3.用雙4選1數(shù)據(jù)選擇器74LS153和反相器(74LS04)實現(xiàn)1位全加器
電路如圖2.4.3,Ai、Bi、Ci―1分別接邏輯開關(guān),Si、Ci接指示燈,驗證電路邏輯功能,列出真值表。指示燈指示燈數(shù)據(jù)開關(guān)數(shù)據(jù)開關(guān)數(shù)據(jù)開關(guān)三.實驗內(nèi)容與實驗線路12/5/202314
5.用3—8線譯碼器74LS138和與非門(74LS20)實現(xiàn)1位全減器
自己設(shè)計電路,驗證電路功能,列出真值表。
說明:全減器實現(xiàn)一位被減數(shù)Ai與減數(shù)Bi,低位來的借位Ji―1相減,結(jié)果得到差數(shù)Di,
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