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第七章ASIC同步設(shè)計(jì)技術(shù)第一節(jié)同步的定義第二節(jié)同步部件第三節(jié)同步計(jì)數(shù)器第四節(jié)波形變換電路第五節(jié)串/并變換電路與并/串變換電路第六節(jié)狀態(tài)產(chǎn)生第七節(jié)中央允許產(chǎn)生器第八節(jié)流水線技術(shù)第一節(jié)同步的定義同步的定義個(gè)系統(tǒng)是同步的,必須滿(mǎn)足以下兩個(gè)條件1)每個(gè)邊沿敏感部件(觸發(fā)器、鎖存器、FIFO等)的時(shí)鐘輸入都來(lái)至同一個(gè)時(shí)鐘的相同邊沿.2)所有存貯元件(包括計(jì)數(shù)器)都是邊沿敏感的,在系統(tǒng)中沒(méi)有電平敏感存貯元件。同步設(shè)計(jì)的優(yōu)點(diǎn)1、ASIC子電路可獨(dú)立設(shè)計(jì)、模擬并通過(guò)同步接口連接,從而實(shí)現(xiàn)真正的分層設(shè)計(jì)。2、同步設(shè)計(jì)可利用自動(dòng)綜合系統(tǒng),從而減輕設(shè)計(jì)者的負(fù)擔(dān)3、全同步系統(tǒng)的模擬及測(cè)試較簡(jiǎn)單。同步設(shè)計(jì)的缺點(diǎn)與相應(yīng)的異步系統(tǒng)相比,全同步系統(tǒng)增加電路的復(fù)雜度。這主要是由于全同步計(jì)數(shù)器需要附加邏輯,系統(tǒng)需要附加電路來(lái)建立復(fù)雜的時(shí)鐘網(wǎng)絡(luò)來(lái)驅(qū)動(dòng)所有的觸發(fā)器。2、需要一個(gè)復(fù)雜的時(shí)鐘分布網(wǎng)絡(luò)3、增加功耗。第二節(jié)同步部件基本的同步部件ASIC設(shè)計(jì)中的基本同步器件為邊沿敏感的D型觸發(fā)器,它的主要指標(biāo)有兩個(gè):建立時(shí)間和保持時(shí)間L

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