三位密碼鎖實驗報告DOC

1、數(shù)字系統(tǒng)設(shè)計實習(xí)（訓(xùn)）報告評語等級：評閱人： 職稱：年 月 日南 工 程實習(xí)（訓(xùn)）報告實習(xí)目的（內(nèi)容）:電子密碼鎖實習(xí)時間：自6月17 日至6月28日共12天實習(xí)地點：三號實驗樓 A307實習(xí)單位：45指導(dǎo)老師：翁嘉民系主任：#目錄1. 引言 52. 設(shè)計思想 62.1 系統(tǒng)原理框圖2.2 總體實現(xiàn)原理3. 芯片主控設(shè)計 73.1 系統(tǒng)設(shè)計方案3.2FPGA有限狀態(tài)機3.3 設(shè)計流程3.4 狀態(tài)編碼3.5 密碼的輸入3.6 密碼記錄與比較3.7 密碼的顯示4. 引腳鎖定 115. 程序仿真 136. 方框圖 147. 心得體會 18基于Verilog HDL的FPGA的電子密碼鎖的設(shè)計報告摘要

2、：基于FPGA設(shè)計的電子密碼鎖是一個小型的數(shù)字系統(tǒng)，與普通機械鎖 相比，具有許多獨特的優(yōu)點：保密性好，防盜性強，可以不用鑰匙，記住密碼即 可開鎖等。目前使用的電子密碼鎖大部分是基于單片機技術(shù)， 以單片機為主要器 件。在實際應(yīng)用中，程序容易跑飛，系統(tǒng)的可靠性較差。本文介紹的一種基于現(xiàn) 場可編輯門陣列FPGA器件的電子密碼鎖的設(shè)計方法，采用VHDL語言對系統(tǒng)進行 描述，并在EP3C10E144C上實現(xiàn)。通過仿真調(diào)試，利用可編程邏輯器件 FPGA的電子密碼鎖的設(shè)計基本達到了 預(yù)期目的。 當(dāng)然，該系統(tǒng)在一些細節(jié)的設(shè)計上還需要不斷地完善和改進， 特別是 對系統(tǒng)的擴展有很好的使用系統(tǒng)和設(shè)計的價值。一、引言

3、數(shù)字電路主要是基于兩個信號(我們可以簡單的說是有電壓和無電壓)，用數(shù)字信 號完成對數(shù)字量進行算術(shù)運算和邏輯運算的電路我們稱之為數(shù)字電路，它具有邏輯運算 和邏輯處理等功能，數(shù)字電路可分為組合邏輯電路和時序邏輯電路。1 EDA簡介EDA( Electronics Design Automation)技術(shù)是隨著集成電路和計算機技術(shù)的飛速 發(fā)展應(yīng)運而生的一種高級、快速、有效的電子設(shè)計自動化工具。它是為解決自動控制系 統(tǒng)設(shè)計而提出的，從70年代經(jīng)歷了計算機輔助設(shè)計(CAD,計算機輔助工程(CAE， 電子系統(tǒng)設(shè)計自動化(ESDA3個階段。前兩個階段的EDA產(chǎn)品都只是個別或部分的解 決了電子產(chǎn)品設(shè)計中的工程

4、問題;第三代EDAT具根據(jù)工程設(shè)計中的瓶頸和矛盾對設(shè)計 數(shù)據(jù)庫實現(xiàn)了統(tǒng)一管理，并提出了并行設(shè)計環(huán)境概念，提供了獨立于工藝和廠家的系統(tǒng) 級的設(shè)計工具。EDA關(guān)鍵技術(shù)之一就是采用硬件描述語言對硬件電路進行描述，且具有 系統(tǒng)級仿真和綜合能力。目前應(yīng)用比較廣泛的硬件描述語言就是/erilog HDL。2 Verilog HDL 簡介Verilog HDI和VHDL樣，是目前大規(guī)模集成電路設(shè)計中最具代表性、使用最廣泛的硬 件描述語言之一。 Verilog HDL 具有如下特點：(1)能夠在不同的抽象層次上，如系統(tǒng)級、行為級、RTL級、門級和開關(guān)級，對設(shè)計系 統(tǒng)進行精確而簡練的描述。(2，能夠在每個抽象層

5、次的描述上對設(shè)計進行仿真驗證，及時發(fā)現(xiàn)及時發(fā)現(xiàn)可能存在的錯誤，縮短設(shè)計周期，并保存整個設(shè)計過程的正確性。（3）由于代碼描述與工藝過程實現(xiàn)無關(guān)，便于設(shè)計標(biāo)準(zhǔn)化，提高設(shè)計的可重用性。如 國有C語言的編程基礎(chǔ)經(jīng)驗，只需很短的時間就能學(xué)會和掌握Verilog HDL，因此， Verilog HDL可以作為學(xué)習(xí)HDI設(shè)計方法的入門和基礎(chǔ)。本設(shè)計名稱為密碼鎖，共有六個模塊，分別為，按鍵去抖、輸入密碼、顯示模 塊、比較模塊、狀態(tài)轉(zhuǎn)換模塊、輸出控制。最終由總程序來實現(xiàn)所需功能。設(shè)計所要實現(xiàn)的功能為：1手動用8個撥碼開關(guān)設(shè)計三位密碼（0-5）或開鎖。2當(dāng)輸入密碼開鎖，當(dāng)密碼輸入正確時，指示燈亮，表示開鎖成功。3

6、當(dāng)密碼輸入錯誤時，燈亮（非同一個燈），表示開鎖失敗。二、設(shè)計思想2.1系統(tǒng)原理框圖本系統(tǒng)由主控芯片（FPGA）,鍵盤，顯示電路，報警電路和開/關(guān)門電路組 成，而主控芯片又可分為按鍵處理部分， 控制部分和譯碼顯示部分。系統(tǒng)原理框 圖如圖2.1所示：2.2 總體實現(xiàn)原理本系統(tǒng)有 8個按鍵， K0,K1,K2,K3,K4,K5 代表數(shù)字 0-9共10個數(shù)字和 1個 確認鍵， 1 個復(fù)位鍵。密碼長度為四位，并且固化在鎖內(nèi)，輸入正確密碼后，按 確認鍵即可開門，本系統(tǒng)設(shè)置為 LED D8 燈亮。在輸入密碼的過程中，當(dāng)用戶鍵 入錯誤密碼時，報警燈 LED D1 燈亮。按下復(fù)位鍵，可使報警停止，同時清除所 有

7、密碼顯示。三、芯片主控設(shè)計3.1 系統(tǒng)設(shè)計方案本電路的主要控制部分和接口輸入部分都是在 FPGA 內(nèi)部通過 Verilog HDL 語言實現(xiàn)的，所以 FPGA 模塊為本設(shè)計的核心。 根據(jù)系統(tǒng)要求的功能， 以及 FPGA 芯片容量的分級，本論文選用 ALTERA 公司 MAX7000S 系列的 EP2C35F672C8 器件作為主控芯片， 它是一種基于乘積項結(jié)構(gòu)的復(fù)雜可編程邏輯器件， 它的基本 邏輯單元是由一些與、或陣列加上觸發(fā)器構(gòu)成， 其中與或陣列完成組合邏輯功能， 觸發(fā)器完成時序邏輯。 它的邏輯控制靈活， 可反復(fù)編程， 有利于系統(tǒng)的擴展和修 改，而且其集成度高，保密性好。作為通用電子密碼鎖，

8、 主要由六個部分組成： 鍵盤處理電路、 輸入密碼電路、 顯示部分、比較密碼部分、狀態(tài)轉(zhuǎn)換部分、輸出控制部分。3.2 FPGA 有限狀態(tài)機本設(shè)計是通過 FPGA 有限狀態(tài)機來實現(xiàn)，設(shè)計有限狀態(tài)機最開始的工作時要 確定電路，包括哪些狀態(tài)，比如某個電路包括四個狀態(tài)，S0,S1,S2,S3然后對所有狀態(tài)給出一個狀態(tài)編碼， 比如為狀態(tài) S 0賦予編碼 00，為狀態(tài) S1 賦予編碼 01， 為狀態(tài)S2賦予編碼10,為狀態(tài)S3賦予編碼11。狀態(tài)編碼是狀態(tài)的標(biāo)識，保存 在寄存器當(dāng)中，對于此編碼形式，只需一個 2 位的寄存器就可以了。FSM Encoding Style 主要有：Binary EncodingO

9、ne Hot EncodingGray Encoding狀態(tài)機可以認為是組合邏輯和寄存器邏輯的特殊租戶，它一般包括兩個部分：組合邏輯部分和寄存器邏輯部分。 寄存器用于存儲狀態(tài)，組合電路用于狀態(tài) 譯碼和產(chǎn)生輸出信號。狀態(tài)機的下一個狀態(tài)及輸出，不僅與輸入信號有關(guān)，而且 還有寄存器當(dāng)前所處的狀態(tài)有關(guān)。根據(jù)輸出信號產(chǎn)生方法的不同，狀態(tài)機可以分成兩類：Mealy型和Moore型。 Moore型狀態(tài)機的輸出只是當(dāng)前狀態(tài)的函數(shù)， 而Mealy型狀態(tài)機的輸出則是當(dāng)前 狀態(tài)和當(dāng)前輸入狀態(tài)的函數(shù)。其原理如下兩圖：Mealy State MachineIn putsNext-State LogicnsStateRe

10、gisterOutputLogicOutputs11#Next state and the outputs depend on the current state and the inputs嚴 next_state(t) = h(current_state(t), input(t)> output(t) = g(current_state(t), input(t)圖3.1Mealy型狀態(tài)機輸出原理Moore State MachineInputs State RegisterOutputsNext state depends on the current state and the I

11、nputs but the output depends only on the present state> next_state(t) = h(currenLstate(t)f input(t)> output = g(current_state(t)圖3.2 Moore型狀態(tài)機輸出原理3.3設(shè)計流程本次密碼鎖的設(shè)計，有限狀態(tài)機應(yīng)該包括以下狀態(tài)：密碼為輸入前的等待狀 態(tài)、輸入密碼時的等待狀態(tài)、輸入密碼正確時的通過狀態(tài)、 輸入密碼錯誤時的警 報狀態(tài)。其中當(dāng)密碼輸入時又可包括以下狀態(tài)，正常輸入狀態(tài)、異常輸入狀態(tài)（包括命令狀態(tài)）、輸入確認狀態(tài)。下面的圖（圖是在程序編譯后，tools-

12、>Netlist_Vewers->RTL Vewer得到的）表示了 密碼輸入的時候的次狀態(tài)機，表示了 4個密碼輸入的順序狀態(tài)，以及輸入完成后 的等待確認狀態(tài)。圖3.4次有效狀態(tài)機的狀態(tài)轉(zhuǎn)換3.4狀態(tài)編碼狀態(tài)編碼主要有二進制編碼、格雷編碼和一位獨熱編碼等方式。格雷編碼時，相鄰狀態(tài)每次只有一個比特位產(chǎn)生變化， 這樣減少了瞬變的次 數(shù)，也減少了產(chǎn)生毛刺和一些狀態(tài)的可能。采用一位獨熱編碼，雖然多用了觸發(fā)器，當(dāng)可以有效節(jié)省和簡化組合電路。對于寄存器數(shù)量多而邏輯相對缺乏的 FPGA器件來說，采用一位獨熱編碼可以有 效提高電路的速度和可靠性，也有利于提高器件資源的利用率。將產(chǎn)生狀態(tài)的組合邏輯電路

13、和用于保存狀態(tài)的寄存器分別寫在不同的 always塊中。其中主要包括：輸出控制部分、警報計時部分、鎖打開后的計時部 分、比較密碼部分、記錄密碼部分和記錄錯誤次數(shù)的部分。3.5 密碼的輸入數(shù)字按鍵輸入的響應(yīng)控制(1) 如果按下數(shù)字鍵，第一個數(shù)字會從顯示器的最左端開始顯示，直到數(shù)輸 完四個數(shù)字。(2) 假如要更改輸入的數(shù)字，按清除鍵清除所有輸入的數(shù)字，再重新輸入四 位數(shù)。(3) 由于這里設(shè)計的是一個四位的電子密碼鎖，所以當(dāng)輸入的數(shù)字鍵超過四個 時，電路不予理會，而且不再顯示第四個以后的數(shù)字。另外由于按鍵的時候同時會引起狀態(tài)機的轉(zhuǎn)換， 所以如果按鍵的時候?qū)Π存I 判斷次數(shù)過多會產(chǎn)生狀態(tài)的過快轉(zhuǎn)換， 記

14、錄的密碼和數(shù)碼管的顯示就同時會出現(xiàn) 錯誤，因此在按鍵部分加入了消除多重按鍵的程序，只檢測一次按鍵的下降沿， 解決了這個問題。/輸入的數(shù)字編碼 09，enter，cancelone=4'b0001, two=4' b0010,three4='b0011,four=4'b0100,five=4'b0101, six=4'b0110,seven=4'b0111,eight=4'b1000,nine=4'b1001, zero=4'b1000,enter=4'b1010,cancel=4'b1011;可以看

15、到，在復(fù)位以后，輸入第 1，2，3，4 個密碼(依次為 1111) 后， passed 變成高電平。當(dāng)過了一定的時間后， passed 變成低電平， 重新計入鍵盤讀入值，進行下一輪的密碼辨別。3.6 密碼記錄與比較程序設(shè)定了一個寄存器用來記錄輸入的密碼。 當(dāng)次有效狀態(tài)機 (即密碼輸入 的狀態(tài)機) 發(fā)生轉(zhuǎn)換并且有密碼輸入時， 程序會記錄下輸入的密碼在寄存器的其 中 4 位里面，最后次有效狀態(tài)轉(zhuǎn)換到確認密碼的狀態(tài)時， 會將記錄下的密碼與固 化在鎖內(nèi)的密碼進行對比， 正確即將主狀態(tài)機轉(zhuǎn)換到通過階段， 錯誤則將狀態(tài)機 轉(zhuǎn)換到報警階段。其中正確錯誤的狀態(tài)轉(zhuǎn)換是通過控制相應(yīng)的標(biāo)志位實現(xiàn)的。3.7 密碼的顯

16、示密碼顯示采用數(shù)碼管動態(tài)掃描顯示，初始時顯示密碼為 4位 0，當(dāng)輸入密碼后數(shù)碼管的第一位、第二位、第三位、第四位會依次顯示輸入的密碼，錯誤后復(fù) 位可以重新輸入。密碼顯示采用的是記錄密碼的寄存器的數(shù)據(jù)， 顯示掃描的掃描 時間設(shè)置為1ms左右，這樣顯示不會出現(xiàn)閃爍或者殘影。四、引腳鎖定1、本設(shè)計中所用的引腳如下：MagicSOP主板10引腳分配表時鐘:clk:PIN_B13按鍵23C13KEY】按鍵CLK10, LVDSCLK5n INFUT24D13KEY2CLK1L LVDSCLKop INPUT25 IN1KEYSCLKL LVDSCLKOn INPUT26PlKEY4CLK3, BTSCL

17、Kln INPUT27ADI 3KEY5CLK14P LTOSCLK7n INPUT28AF14KEY6CLK13P LT)SCLK6p INPUT29P25KEY?CLK6t LVT)SCLK3p INPUT30P26KEYSCLK7, LTOSCLK3n INPUTLED燈1R5LED110,LVDS24n2P9LED210?LVDSSln3P7LED3"to?LTOS22p? DQ1L3/DQSL3斗P6LEMio,LTOS22iit DQ1L4/DQ3L45P3LED5LED流水燈10, LVDS26P，(DPCLK1/D()S1L)/(DPCLK1/DQS16K8LED61

18、0,LVDSTp7帕LED?ISLVDS20p, DQ1L7/DQ3L78T3LED810,LVDS21nP DQ1L6/DQ3LB39J8SEGO40M3SEG141K6SEG2動態(tài)數(shù)碼管數(shù)碼管顯示I0h LVDSJIp10, LVDS27p,(DPCLKO/DQSOL)/IDPCLKO/DQSOI0h LTOS42p42J6SEG310, DQ2L0/DQ1L0J3U10SEG4I0a LVDSlSn44X9SEG510, LVDS31pr 45LIOSEG6IO461?SEG7IO47L6DIGOIO3 LWS30n, DQ0L6/DQlLlb(48K5DIG1IO, LTS42n49G

19、3DIG210, LDS41n50GADIG310, LVDS41p61J3DIG410, LVDS36pt DQ2L7/DQ1L7r 52K1DIGSIOa LVDS33pt DQOL1/DQ1L1O53L3DIG610，LWS29n, /DQlL17b4曲DIG?10, LTS28p2、電子密碼鎖引腳鎖定圖clkO LocationPIN_B13 Yesthreel Locati ontwo1 Locati onPIN_N1 YesPIN D13 Yesdig7Locati onPIN_M4Yesdig6Locati onPIN_L3 Yesdig5Locati onPIN_K4 Yesd

20、ig4Locati onPIN_J3 Yesdig3Locati onPIN_G4 Yesdig2Locati onPIN_G3 Yesdig1Locati onPIN_K5 Yesdig0Locati onPIN_L6 Yesone1Locati onPIN_C13Yesfour1Locati onPIN_P1 Yesfive1Locati onPIN_AD13YesresetbLocati onPIN_P25Yessixl Location PIN_AF14 Yes15#yes Location PIN_P26 Yes#passed7 Locati onPIN_T3 Yespassed6

21、Locati onPIN_R6 Yespassed5 Locati onPIN_R8 Yes16passed4Locati onPIN_P3 Yespassed3Locati onPIN_P6 Yespassed2Locati onPIN_P7 Yespassed1Locati onPIN_P9 Yespassed0Locati onPIN_R5 Yesseg7Locati onPIN_L9 Yesseg6Locati onPIN_丄10Yesseg 5Locati onPIN_N9 Yesseg4Locati onPIN_U10Yesseg3Locati onPIN_J6 Yesseg2Lo

22、cati onPIN_K6 Yesseg1Locati onPIN_M3Yesseg0Locati onPIN_J8 Yes五、程序仿真17六、模塊方框圖總方框圖蠶419曲Ext輸入密碼rtktreetb:1. rose:還, >u：i s'ate*ttexl sub 百 LdLa1. rese:-41,bull slalc. firs'rfl9記錄按方順序L fi rst2. second3. Ihiru4. fourth5. fitiidi甯碼槍入L reseO-Ot1key_prViJs«l_f： lag=0t?比數(shù)字輸人!*5rty_fMr*jssd_f

23、 iagt-r狀態(tài)轉(zhuǎn)換讐：i 煦:；III alati fuuii: l|y cuuatT'r1. reset b-0»mnin町朋i：p; 2. resetb «tab SlElli?-nflii >itn：eCTI-> C- klVnI sifftflCITLUIcdrfeciInuti i sr nlf-tain state2199-trim】f霍無壬霹-tfi'ti-貝冒PH'-rHg 42：X翱*1f f fP34E農(nóng)?-J£®®ii1 二 Jhh1-Lt匚程序中每個always語句對應(yīng)一個方框，其

24、方框如下:： 1 ： 1 ：'z 1"i:i:i« :h:p:5:i:I' '1*luulo sLutti 1Z: 1 :clkL_rI p " errorF"11>pr她一團日clkOii：i：c&rfodi, H廠' "IZ1ZI:Rit'QclKiro阿is_wuinl-neiTtatei :1 : : 1:!k“aXii_counl -rt Tjf_CCMllDtZ1=1£r. . "1 . 1:1:1:1:11 : 1 : :1:II:1:zr - :L-10

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27、入X,.理陰bPL kejjMwssad fkK-0a. ft taxtlkOdit * dkO-dii3-0xV.A ft26#實訓(xùn)心得一1短暫的兩周實訓(xùn)已在不知不覺中接近了尾聲， 本次實訓(xùn)我們做的是電子密碼 鎖，雖然我是主力，但每項工作都是在我們的共同參與下完成的。這兩周的實訓(xùn) 讓我學(xué)到了很多實用性的知識，不僅讓我更深層次的對課本的理論知識有了深入 的理解，而且還讓我對分析事物的邏輯思維能力得到了鍛煉，提高了實際動手能力。開始時我們的程序使用的是六個分模塊，但在例化語句的編寫上出現(xiàn)了問 題。后來經(jīng)過討論我們決定使用一個整體程序， 然而在編寫主控模塊時，我遇到 了很大的困難，一直被定時問題所

28、困擾，那就是密碼的輸入與狀態(tài)的循環(huán)， 本來 用的是狀態(tài)機，但由于狀態(tài)機總是有一個狀態(tài)被綜合掉，而導(dǎo)致仿真波形出不來。 然而模塊分好后，時序圖卻一直沒有調(diào)出來，不過高興的是當(dāng)我們的程序下載到 試驗箱上的時候，功能還是實現(xiàn)了。即輸入正確密碼時，燈亮，同時開鎖進入； 而當(dāng)密碼輸入錯誤時， 報警并且不能開鎖進入。 接下來我們需要做的就是增進我 們密碼鎖的功能了， 畢竟我們所需要的是可以直接更改密碼， 而不是將密碼固化 在鎖內(nèi)，這個過程花費了幾天的時間， 同時也上網(wǎng)查閱了好多的資料， 當(dāng)然也離 不開其他同學(xué)對我們的幫助， 終于功夫不負有心人， 我們的密碼鎖總算實現(xiàn)了它 應(yīng)有的功能。通過本次實訓(xùn)， 不僅讓

29、我學(xué)到了實用性的知識， 更讓我意識到了團隊合作的 重要性。也讓我意識到只有理論知識是遠遠不夠的， 只有把所學(xué)的理論知識與實 踐相結(jié)合起來， 從理論中得出結(jié)論， 才能真正為社會服務(wù)， 從而提高自己的實際 動手能力和獨立思考的能力。 同時也非常感謝學(xué)校為我們提供這樣專業(yè)的實踐平 臺還有甕老師在兩周實訓(xùn)以來對我們的不斷指導(dǎo)以及同學(xué)們對我們的熱情幫助。實訓(xùn)心得 2短暫的兩周實訓(xùn)已經(jīng)過去了，本次EDA實訓(xùn)讓我感覺收獲頗多，在這一周的 實訓(xùn)中我們不僅鞏固了以前學(xué)過的知識， 而且還學(xué)到了 Verilog 語言設(shè)計密碼鎖 的整個過程， 同時也提高了我們的思考能力與實際動手操作能力。 下面談一下就 這兩周實訓(xùn)中

30、我自己的一些心得體會。兩周的實訓(xùn)，讓我們在老師提供的實踐平臺上通過自己的實踐學(xué)到了很多課 本上學(xué)不到的寶貴東西，熟悉了對 Quartus U軟件的一般項目的操作和學(xué)到了 處理簡單問題的基本方法， 更重要的是掌握了 Verilog 語言的基本設(shè)計思路和方 法，我想這些會對我今后的學(xué)習(xí)起到很大的助推作用。 此外， 還要在今后的課本 理論知識學(xué)習(xí)過程中要一步一個腳印的扎實學(xué)習(xí)， 靈活的掌握和運用專業(yè)理論知 識這樣才能在以后出去工作的實踐過程中有所成果。本次實訓(xùn)中我們遇到的最大困難就是一直沒能修改密碼， 開始時我們一直不 明白為什么， 但經(jīng)過我們對程序再三的琢磨， 終于明白了原因， 因為我們使用了 狀

31、態(tài)機，所以輸入密碼時總是顯示的前一個狀態(tài)輸入的密碼， 而導(dǎo)致密碼修改出 現(xiàn)了問題，但經(jīng)過老師對我們的悉心指導(dǎo)，我們意識到了自己的錯誤。甕老師多次詢問設(shè)計進程， 并為我們指點迷津， 幫助我們理順設(shè)計思路， 精 心點撥。甕老師一絲不茍的作風(fēng)，嚴謹求實的態(tài)度，踏踏實實的精神，不僅授我 以文，并將積極影響我今后的學(xué)習(xí)和工作。在此誠摯地向甕老師致謝。兩周的實訓(xùn)，讓我學(xué)到了好多課本上及課外的知識。深刻體會到了，理論是 一回事，真正實踐下來就會很難！由于老師的指導(dǎo)，同學(xué)的幫助，以及我們的團 結(jié)協(xié)作，我們圓滿的完成了設(shè)計！ 非常感謝在實訓(xùn)期間幫助我們的所有人， 尤其 是翁老師，多次為我們指點迷津，并幫助我們理順設(shè)計思路，精心點播。實訓(xùn)心得 3 通過本次實驗的課程設(shè)計，加深自己對課本知識的理解和鞏固。我感覺有 很大的收獲。這次 EDA 課程設(shè)計歷時兩個星期，在整整兩個星期的日子里，可 以說是苦多于甜， 但是可以學(xué)到很多很多的東西， 同時不僅可以鞏固以前所學(xué)過 的知識，而且學(xué)到了很多在書本上所沒有學(xué)到過的知識。 通過這次設(shè)計， 進一步 加深了對 ED