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fpga開(kāi)發(fā)板使用教程之在K7上用Ibert實(shí)現(xiàn)基本的GTX測(cè)試GTX、GTH等具體是什么就不多介紹了,網(wǎng)上有很多。寫(xiě)這個(gè)的目的,就是當(dāng)收到FPGA板卡后,要判斷本板的高速串行總線是否能夠應(yīng)用,那就需要做基本的功能測(cè)試。我們可以用xilinx提供的ibert進(jìn)行測(cè)試,而且基本上可以達(dá)到不用敲代碼就可以完成測(cè)試的目的。下面按步驟,一步一步實(shí)現(xiàn)。重點(diǎn)的地方我會(huì)標(biāo)注出來(lái)。(1)新建工程,只需選擇好與板卡對(duì)應(yīng)的FPGA型號(hào)即可,無(wú)須添加任何文件。(2)添加ibertIP。(3)配置IP:這里我們先只配置一個(gè)quad,也就是測(cè)試一個(gè)quad,速度是1G的速度,也就是千兆網(wǎng)的速度。這里是8b/10b編碼。因此實(shí)際1000Mbpsx10/8=1.25Gbps。參考時(shí)鐘這里,你要看你的硬件上是接的多少M(fèi)的時(shí)鐘。也就是MGT的refclk引腳上,并注意是哪個(gè)quad。在我的電路中,我的125MHz的差分時(shí)鐘是接到了MGTREFCLK1P_115和MGTREFCLK1N_115上。這里需要注意的是:參考時(shí)鐘頻率和GTX的傳輸速率的關(guān)系。雖然在內(nèi)部是通過(guò)PLL倍頻上去的,但是,基本時(shí)鐘頻率是要匹配才行。比如125MHz,10倍頻就可以達(dá)到1.25GHz。如果55MHz參考時(shí)鐘,倍到1.25GHz,就不行了。假若是10GHz的速度,因?yàn)?0GHz就是64b/66b的編碼,實(shí)際速度是:10000x66/64=10.3125Gbps。這時(shí)用156.25MHz的時(shí)鐘就比較合適(156.25MHzx66=10.3125GHz)。如果其他頻率的,存在小數(shù)倍頻,那就不行了,pll很難鎖定。因?yàn)槲疫@里選的速度是1.25GHz,那后面的QuadPLL就不能選擇,否則提示錯(cuò)誤。1.25GHz頻率低于QuadPLL的范圍。因此,這里不選中QuadPLL,默認(rèn)采用CPLL。(4)這部分就是要選擇你要測(cè)哪個(gè)quad以及對(duì)應(yīng)的時(shí)鐘。我這里測(cè)115哪個(gè)quand,參考時(shí)鐘前面已經(jīng)說(shuō)了是在MGTREFCLK1P_115和MGTREFCLK1N_115上,所以做如下選擇:(5)在clocksetting里,是設(shè)置ibert內(nèi)部邏輯使用的時(shí)鐘,這里可以用從其他bank引入的時(shí)鐘,也可以直接用前面的quad時(shí)鐘?,F(xiàn)在為了簡(jiǎn)單,直接使用前面的115上的時(shí)鐘。至此,點(diǎn)擊“OK”產(chǎn)生ibertIP。(6)在剛才生成的ibertIP上右鍵,選擇:OpenIPExampleDesign。又會(huì)重新打開(kāi)一個(gè)Vivado,然后生成一個(gè)新的工程。在這個(gè)工程里,你可以不做任何更改。當(dāng)然,你可以在頂層文件中加入一些其他邏輯,比如控制你的晶振、指示燈等(7)在(6)的工程里里直接生成bit文件,先后下載到FPGA板卡上。(8)下載完后,會(huì)點(diǎn)擊createlinks。添加通道:選擇回環(huán):(9)連接建立如下,誤碼率比較高,復(fù)位一下就可以了:(10)這里可以選擇回環(huán)模式。如果只是在本板測(cè)試的話,就只能是near端回環(huán)了。(11)在這里顯示notlocked,是因?yàn)槲覀兦懊鏇](méi)有用quadpll,而用了cpll,不影響傳輸。(12)還可以看眼圖,在對(duì)應(yīng)通道上右擊,選擇createscan:直接OK,就會(huì)出現(xiàn)眼圖,藍(lán)色部分越大,越好。如果選擇遠(yuǎn)端回環(huán),速度越高,眼自然會(huì)開(kāi)的要?。海?3)至此,基本的測(cè)試完畢??偨Y(jié):整個(gè)測(cè)試是很簡(jiǎn)單的,沒(méi)有過(guò)多的可設(shè)置項(xiàng)。關(guān)鍵的就是要把時(shí)鐘頻率、時(shí)鐘位置對(duì)應(yīng)好。(在ug476的P345開(kāi)始,有MG

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