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EDA實現(xiàn)多功能數(shù)字鐘實驗報告實驗EDA實驗數(shù)字鐘實驗任務用FPGA器件和EDA技術實現(xiàn)多功能數(shù)字鐘的設計已知條件:1.MAX+PlusII軟件2..FPGA實驗開發(fā)裝置基本功能:1.以數(shù)字形式顯示時,分,秒的時間;2.小時計數(shù)器為24進制;3.分,秒計數(shù)器為60進制;多功能數(shù)字電子鐘設計:輸入變量:時鐘CPS,直接清零RD;輸出變量:小時H[7..4]、H[3..0]為8421BCD碼輸出,其時鐘為CLK;分計時M[7..4]、M[3..0]為8421BCD碼輸出,其時鐘為CPM;秒計時S[7..4]、S[3..0]為8421BCD碼輸出,其時鐘為CLK;RD為清零信號等。二.仿真與波形1.60進制原理圖如下;其仿真波形如下:2.24進制原理圖如下:其仿真波形如下:3.數(shù)字鐘的整個電路圖如下:邏輯電路說明:由電路分析得知,多功能數(shù)字電子鐘最基本的計時電路在CLK(秒)時鐘作用下,電路輸出變量為H[7..0],M[7..0]及S[7..0],按8421BCD碼正常走時,電路為異步時序邏輯電路4.數(shù)字電子鐘的仿真波形如下:仿真波形分析及結論:由仿真波形分析得知在CLK(秒)時鐘作用下,電路正常走時。分析過程完全符合多功能數(shù)字電子鐘最基本的計時功能,邏輯電路設計正確。三.感想:這次的課程設計的內容是《EDA多功能數(shù)字鐘》,這次課程設計驗我花了兩個上午的時間。雖然我是順利的完成了任務,但是在實驗中我還是發(fā)現(xiàn)了自己存在的一些問題。在課程設計中我經常做完上一步就忘記了下一步該怎么做,總是一邊看老師的課件一邊做,這樣一來浪費了不少時間,這是由于我對軟件的操作不熟練的緣故,因此我覺得我應該在今后的日子里多練習一下這個MAX+PLUS軟件,做到在以后的學習及工作中能利用這個軟件快速的正確的完成任務。在實驗中我還經常出現(xiàn)掉步驟的現(xiàn)象,比如經常忘記“指向當前文件”,從而導致得到的結果是錯誤的甚至根本就得不到結果,這全都是因為粗心

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