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![組合邏輯電路實(shí)驗(yàn)報(bào)告_第2頁(yè)](http://file4.renrendoc.com/view/e640bee1af9a0d9c74cba00cb1b60c5e/e640bee1af9a0d9c74cba00cb1b60c5e2.gif)
![組合邏輯電路實(shí)驗(yàn)報(bào)告_第3頁(yè)](http://file4.renrendoc.com/view/e640bee1af9a0d9c74cba00cb1b60c5e/e640bee1af9a0d9c74cba00cb1b60c5e3.gif)
![組合邏輯電路實(shí)驗(yàn)報(bào)告_第4頁(yè)](http://file4.renrendoc.com/view/e640bee1af9a0d9c74cba00cb1b60c5e/e640bee1af9a0d9c74cba00cb1b60c5e4.gif)
![組合邏輯電路實(shí)驗(yàn)報(bào)告_第5頁(yè)](http://file4.renrendoc.com/view/e640bee1af9a0d9c74cba00cb1b60c5e/e640bee1af9a0d9c74cba00cb1b60c5e5.gif)
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實(shí)驗(yàn)名稱:組合邏輯電路設(shè)計(jì)一、實(shí)驗(yàn)?zāi)康募耙?、了解組合邏輯的設(shè)計(jì)步驟。2、掌握組合邏輯電路的分析方法與測(cè)試方法。3、了解組合邏輯電路的冒險(xiǎn)現(xiàn)象及其消除方法。二、實(shí)驗(yàn)環(huán)境WindowsXp虛擬機(jī)QuartusII8.0三、實(shí)驗(yàn)內(nèi)容與步驟3、用74LS151(八選一數(shù)據(jù)選擇器)產(chǎn)生邏輯函數(shù)Y=+AC+BC,寫出設(shè)計(jì)步驟,畫出邏輯電路圖并通過(guò)驗(yàn)證。步驟:將給出的函數(shù),化為最小項(xiàng),Y=+ABC+AC+BC;畫出真值表;(表3-1)選擇標(biāo)準(zhǔn)器件驗(yàn)證所得出的邏輯函數(shù)表達(dá)式。(圖3-2)4、用74LS138(三線一八譯碼器)及74LS20(雙四輸入與非門)構(gòu)成函數(shù)發(fā)生器實(shí)現(xiàn)函數(shù):P=AC+(B+C).步驟:(1)將給出的函數(shù),化為最小項(xiàng),P=AC+BC+B+C(2)畫出真值表;(表4-1)(3)選擇標(biāo)準(zhǔn)器件驗(yàn)證所得出的邏輯函數(shù)表達(dá)式。(圖4-2)5、用74LS151(八選一數(shù)據(jù)選擇器),實(shí)現(xiàn)邏輯函數(shù)Y=AB+CD。步驟:(1)將給出的函數(shù),化為最小項(xiàng),Y=ABCD+AB+ABD+ABC+CD+BCD+ACD(2)畫出真值表;(表4-1)(3)選擇標(biāo)準(zhǔn)器件驗(yàn)證所得出的邏輯函數(shù)表達(dá)式。(圖4-2)四、調(diào)試過(guò)程及實(shí)驗(yàn)結(jié)果3、將最小項(xiàng)Y=+ABC+AC+BC寫成Y=m0D0+m3D3+m5D5+m7D7,根據(jù)式子,D0,D3,D5,D7都接高電平,其余的接低電平。列出真值表:ABCY00010010010001111000101111001111邏輯圖:4、根據(jù)題目要求,需要用到74LS20(雙輸入與非門),將式P=AC+BC+B+C寫成P=m1+m2+m3+m5,即列出真值表:ABCY00000011010101111000101111001110邏輯圖5、將式Y(jié)=ABCD+AB+ABD+ABC+CD+BCD+ACD寫成Y=D3m3+D7m7+D11m11+D12m12+D13m13+D14m14+D15m15,因?yàn)?4LS151是八選一數(shù)據(jù)選擇器,只有3個(gè)輸入端,而題目給出的是4個(gè)輸入,所以,可以通過(guò)控制D的高低電平來(lái)實(shí)現(xiàn)該式子。0~7對(duì)應(yīng)的輸入,按照74LS151正常使用輸入;8~15輸入時(shí),按以下方法,即DnABC,例如D13m13,輸入時(shí),D5接高電平,其余不變。A、B、C輸入101,。對(duì)應(yīng)真值表:DnABCY00000101001111001011101111100010011010101111100111011111011111五、分析與討論個(gè)人對(duì)于74LS138的功能不太了解,因此在做實(shí)驗(yàn)時(shí),把每個(gè)輸出都接上,導(dǎo)致無(wú)法正常判斷輸出結(jié)果的正確性。對(duì)于附加題的感想是,只要平時(shí)有復(fù)習(xí),做題時(shí)肯動(dòng)腦,并
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