山東建筑大學(xué)數(shù)字電子技術(shù)期末復(fù)習(xí)題_第1頁(yè)
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山東建筑大學(xué)數(shù)字電子技術(shù)期末復(fù)習(xí)題_第3頁(yè)
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1.在數(shù)字電路中三極管主要工作在()兩個(gè)區(qū)域。2.欲將兩個(gè)邏輯門(mén)輸出端相連,以實(shí)現(xiàn)線與的功能,應(yīng)采用()。V應(yīng)為()。4.能實(shí)現(xiàn)算術(shù)加法運(yùn)算的電路是()CMOS路的邏輯關(guān)系表達(dá)式為()。6.8位移位寄存器,串行輸入時(shí)經(jīng)()個(gè)脈沖后,8位數(shù)碼全部移入寄存器中。所示,設(shè)二極管是理想的。該電路實(shí)現(xiàn)的邏輯關(guān)系為()。1.A/D轉(zhuǎn)換器是能把()信號(hào)轉(zhuǎn)換為()信號(hào)的電路。2.JK觸發(fā)器能執(zhí)行置1、置0、()和()四種邏輯操作。3.MOS管作為開(kāi)關(guān)器件應(yīng)工作在輸出特性曲線的()區(qū)和()區(qū)。4.請(qǐng)寫(xiě)出JK觸發(fā)器的特性方程()。5.A/D轉(zhuǎn)換器的轉(zhuǎn)換過(guò)程,可分為采樣、保持、()和()4個(gè)步驟。10000000時(shí),輸出電壓的為()。下列函數(shù)化為最簡(jiǎn)與或式。答:化為最簡(jiǎn)與或式。滿(mǎn)足要求,產(chǎn)品就算合格(輸出用F表示)。試設(shè)計(jì)一個(gè)檢驗(yàn)產(chǎn)品合格的邏輯電路,(1)列寫(xiě)該邏輯問(wèn)題的真值表。(2)用卡諾圖法化簡(jiǎn),寫(xiě)出最簡(jiǎn)與或表達(dá)式。(3)畫(huà)出利用三輸入與非門(mén)實(shí)現(xiàn)該邏輯問(wèn)題的電路圖。

1.正邏輯規(guī)定高電平為()態(tài),低電平為()態(tài)。2.()門(mén)的多余輸入端可以接高電平,()門(mén)的多余輸入端可以接地;()門(mén)和()門(mén)3.2K×4位的RAM有()個(gè)地址輸入端,有()個(gè)I/O端。4.在數(shù)字電路中,穩(wěn)態(tài)時(shí)三極管一般都工作在()、()狀態(tài)。5.要構(gòu)成一個(gè)五進(jìn)制計(jì)數(shù)器最少需要()個(gè)觸發(fā)器,其無(wú)效狀態(tài)有()個(gè)。6.編碼器和比較器屬于

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