
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1、多處理器系統(tǒng)中nios ii軟核處理器啟動(dòng)方案的設(shè)計(jì)nios ii 處理器是公司設(shè)計(jì)的一款基于的32位risc軟核處理器,具有32位命令集、數(shù)據(jù)通路及地址空間,是其可編程系統(tǒng)芯片(sopc)的核心。nios ii系統(tǒng)采納altera公司設(shè)計(jì)的一套avalon交換結(jié)構(gòu),avalon總線上的全部信號(hào)都與系統(tǒng)時(shí)鐘同步且地址、數(shù)據(jù)和控制信號(hào)用法自立的端口;支持各種傳輸方式;采納從端口仲裁機(jī)制,對(duì)于有多個(gè)主設(shè)備的系統(tǒng)可以提高系統(tǒng)的吞吐量。采納基于fpga 的nios ii軟核處理器很簡(jiǎn)單在嵌入式系統(tǒng)設(shè)計(jì)中實(shí)現(xiàn)多處理器系統(tǒng)。在這樣的多處理器系統(tǒng)中,普通外部處理器做主處理器,nios ii處理器為從處理器,
2、兩個(gè)處理器有共用的存儲(chǔ)器可以舉行數(shù)據(jù)交互。本文將通過(guò)對(duì)nios ii系統(tǒng)啟動(dòng)的討論設(shè)計(jì)一計(jì)劃,用外部處理器配置fpga,加載程序代碼到nios ii系統(tǒng)中的程序存儲(chǔ)器中,終于完成nios ii系統(tǒng)的啟動(dòng)。在多處理器系統(tǒng)的啟動(dòng)計(jì)劃在多處理器系統(tǒng)中,為了降低成本,可以省去nios ii的一個(gè)非易失性存儲(chǔ)器外設(shè),如flash、eprom等,nios ii處理器通過(guò)avalon交換結(jié)構(gòu)銜接易失性存儲(chǔ)器,一個(gè)外部主處理器及一些須要的接口外設(shè)。因此延遲nios ii的啟動(dòng)是須要的,解決方法是在nios ii系統(tǒng)中設(shè)計(jì)一啟動(dòng)延遲模塊,把此模塊的基址設(shè)為nios ii的復(fù)位地址。通過(guò)此模塊,nios ii處理
3、器上電復(fù)位后啟動(dòng)被延遲,直到數(shù)據(jù)被傳輸完畢,外部處理器通過(guò)啟動(dòng)延遲模塊向nios ii發(fā)送一個(gè)可以開頭進(jìn)入程序存儲(chǔ)器的命令,然后跳轉(zhuǎn)到程序存儲(chǔ)器開頭執(zhí)行,完成后續(xù)的設(shè)備初始化及應(yīng)用程序的執(zhí)行。外部處理器通過(guò)時(shí)序轉(zhuǎn)接橋銜接在avalon交換結(jié)構(gòu)上和nios ii處理器共同構(gòu)成的一個(gè)雙處理器系統(tǒng)1所示。黑色箭頭表示nios ii啟動(dòng)延遲模塊是通過(guò)avalon交換結(jié)構(gòu)銜接的。圖1 多處理器系統(tǒng)的啟動(dòng)計(jì)劃結(jié)構(gòu)啟動(dòng)計(jì)劃的硬件設(shè)計(jì)啟動(dòng)延遲模塊2所示,它有兩個(gè)從端口s1、s2:s1一端銜接在啟動(dòng)延遲模塊中的rom單元上,另一端通過(guò)avalon總線銜接在nios ii處理器的命令主端口;s2一端銜接在啟動(dòng)延遲
4、模塊的控制寄存器上,另一端通過(guò)avalon總線銜接在外部處理器和nios ii處理器的數(shù)據(jù)主端口。圖2中箭頭的方向表示數(shù)據(jù)的流向。圖2 nios ii啟動(dòng)模塊的硬件結(jié)構(gòu)在此需做兩點(diǎn)解釋:* 在啟動(dòng)延遲模塊中有兩個(gè)寄存器,這兩個(gè)寄存器定義如下:解釋:控制寄存器1用于存放niosii程序存儲(chǔ)器中_start程序的入口地址??刂萍拇嫫?中跳轉(zhuǎn)標(biāo)記位(31_1位保留) 。這兩個(gè)寄存器值由外部處理器來(lái)寫入,其中偏移量為0的寄存器存放nios ii程序存儲(chǔ)器中_start程序的入口地址,此值由外部處理器寫入;偏移量為1的寄存器只用了第0位,其它位保留,當(dāng)外部處理器配置好nios ii處理器系統(tǒng)后,會(huì)向此寄
5、存器的第0位寫入1,否則保持為0。* rom中的數(shù)據(jù)是外部處理器在配置fpga的時(shí)候?qū)懭氲?,因此只要fpga配置完成后,啟動(dòng)代碼就存放進(jìn)rom中了。rom的大小要按照啟動(dòng)程序代碼的大小來(lái)打算,設(shè)計(jì)中應(yīng)盡可能降低這段程序的代碼存儲(chǔ)量。下邊是用 硬件描述語(yǔ)言編寫的啟動(dòng)延遲模塊的硬件代碼的主體框架結(jié)構(gòu):/ 讀端口():boot_rom the_boot_rom(.clock (s1_clk), file:/s1_clk為來(lái)自avalon總線模塊上的s1端口的時(shí)鐘信號(hào).aclr (s1_reset), file:/s1_reset為來(lái)自avalon總線模塊上的s1端口的復(fù)位信號(hào).q (s1_readd
6、ata), file:/s1_readdata為流向avalon總線模塊的s1端口的32位數(shù)據(jù).address (s1_address)file:/s1_address為來(lái)自于avalon總線模塊的s1端口的地址);file:/控制寄存器讀寫端口(s2):control_register the control_register(.clk (s2_clk),file:/s2_clk為來(lái)自avalon總線模塊上的s2端口的時(shí)鐘信號(hào).reset (s2_reset), file:/s2_reset為來(lái)自avalon總線模塊上的s2端口的復(fù)位信號(hào).read (s2_read), file:/s2_r
7、ead為來(lái)自avalon總線模塊上的s2端口的讀使能信號(hào).write (s2_write), file:/s2_write為來(lái)自avalon總線模塊上的s2端口的寫使能信號(hào).schipselect (s2_chipselect), file:/s2_chipselect為來(lái)自avalon總線模塊上的s2端口的片選信號(hào).address (s2_address), file:/s2_address為來(lái)自avalon總線模塊上的s2端口的地址.readdata (s_readdata), file:/s2_chipselect為流向avalon總線模塊上的s2端口的32位讀數(shù)據(jù).writedata
8、(s2_writedata) file:/s2_writedata為來(lái)自avalon總線模塊上的s2端口的32位寫數(shù)據(jù));啟動(dòng)計(jì)劃的軟件設(shè)計(jì)啟動(dòng)計(jì)劃的軟件設(shè)計(jì)目標(biāo)是當(dāng)系統(tǒng)復(fù)位后,在外部處理器向nios ii程序存儲(chǔ)器和數(shù)據(jù)存儲(chǔ)器傳輸數(shù)據(jù)的過(guò)程中,nios ii處理器運(yùn)行要受到外部處理器的控制。當(dāng)一切就緒后,外部處理器發(fā)出一條釋放nios ii處理器的指令,接下來(lái)nios ii處理器就可以正常運(yùn)行了。軟件部分主要就是存放在啟動(dòng)延遲模塊中rom的代碼,此代碼主要是檢測(cè)啟動(dòng)延遲模塊中控制寄存器2的第0位是否為1。若為1,則跳轉(zhuǎn)到控制寄存器1中所存儲(chǔ)的地址處執(zhí)行。若設(shè)控制寄存器的基址為control_reg_base,為了削減代碼量,這段代碼簡(jiǎn)單用nios ii的匯編命令來(lái)實(shí)現(xiàn),代碼部分在此從略。最后本計(jì)劃在我們自己設(shè)計(jì)的一塊開發(fā)板上經(jīng)過(guò)測(cè)試,能夠正確完成nios ii 處理器的啟動(dòng)。結(jié)語(yǔ)采納多處理器的系統(tǒng)雖然可以提高系統(tǒng)的性能,但傳統(tǒng)的多處理器系統(tǒng)普通只
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