數(shù)字電路制作與調(diào)試項目化教程（活頁式） 課件 100-2 加法運算器_第1頁
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加法運算器2下頁上頁兩個二進制數(shù)之間的算術(shù)運算（加、減、乘、除），目前在數(shù)字計算機中都是化作若干步加法運算進行的。加法器是構(gòu)成算術(shù)運算器的基本單元。1.1位加法器（1）半加器如果不考慮來自低位的進位，將兩個1位二進制數(shù)相加，稱為半加。實現(xiàn)半加運算的電路叫做半加器。返回3下頁上頁符號01ABSCO輸入輸出半加器的真值表A：加數(shù)B：被加數(shù)S：和

CO：向高位的進位返回000100111010014下頁上頁在兩個多位二進制數(shù)相加時，除了最低位以外，每一位都應(yīng)該考慮來自低位的進位，即將兩個對應(yīng)的加數(shù)和來自低位的進位3個數(shù)相加。這種運算稱為全加。所用的電路稱為全加器。（2）全加器返回5下頁上頁CIABSCO輸入輸出全加器的真值表返回00010000101001110010111011101001100101114位串行進位加法器2.多位加法器（1）串行進位加法器（SerialCarryAdder）缺點：運算速度慢。依次將低位全加器的進位輸出CO，接到高位全加器的進位輸入端CI，即構(gòu)成多位加法器。7下頁上頁優(yōu)點：運算速度提高。缺點：電路復雜程度隨位數(shù)的增加急劇上升。（2）超前進位加法器（Look-aheadCarryAdder）通過邏輯電路先得出每一位全加器的進位輸入信號,采用這種結(jié)構(gòu)形式的加法器叫做超前進位加法器。返回8下頁上頁返回3.74LS283集成四位加法器集成芯片A1–A4：運算輸入端B1–B4：運算輸入端C0：進位輸入端Σ1–Σ4：和輸出端C4：進位輸出端輸入端A4～A1：輸入0101(十進制數(shù)5)；輸入端B4～B1：輸入0100(

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