數(shù)字電路邏輯設(shè)計(jì)課件：6-1_第1頁
數(shù)字電路邏輯設(shè)計(jì)課件：6-1_第2頁
數(shù)字電路邏輯設(shè)計(jì)課件：6-1_第3頁
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文檔簡介

時(shí)序邏輯電路任何時(shí)刻的輸出不僅取決于當(dāng)時(shí)的輸入信號，而且還取決于電路原先的工作狀態(tài)，即與以前的輸入信號及輸出也有關(guān)系。6.1時(shí)序邏輯電路概述1TC1CPQ&X&Z圖6-1-1

簡單時(shí)序電路分析圖6-1-1所示時(shí)序電路。T'由T觸發(fā)器的狀態(tài)方程和電路的輸出方程，可以畫出電路的工作波形圖。CPXQZQZ(a)(b)(c)(d)圖6-1-2圖6-1-1所示電路工作波形

結(jié)論：時(shí)序邏輯電路在結(jié)構(gòu)上有兩個(gè)特點(diǎn)。第一，包含組合邏輯電路和存儲電路兩部分。第二，組合電路至少有一個(gè)輸出反饋到存儲電路的輸入端，存儲電路的狀態(tài)至少有一個(gè)作為組合電路的輸入，與其他輸入共同決定電路的輸出。存儲電路組合邏輯電路Z(z1,z2,···zj)W(w1,w2,···wk)Y(y1,y2,···yl)X(x1,x2,···xi)Z(tn)＝F［X(tn),Y(tn)］ 輸出函數(shù)W(tn)＝G［X(tn),Y(tn)］ 存儲電路的激勵(lì)函數(shù)Y(tn+1)＝H［W(tn),Y(tn)］存儲電路的狀態(tài)方程圖6-1-3

時(shí)序電路方框圖時(shí)序電路可分為同步時(shí)序邏輯電路和異步時(shí)序邏輯電路。

同步時(shí)序邏輯電路，存儲電路的狀態(tài)變更是由

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