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文檔簡介

1、.2013數(shù)字電路復習資料一、選擇題1、二進制數(shù)(101010)2可轉(zhuǎn)換為十進制數(shù)（ A ）。（A）(42)10 （B）(84)10 （C）(52)10 2、下圖所示門電路的輸出為（ C ）。（A） （B） （C）3、已知邏輯函數(shù)的輸入AB波形如下圖所示，則輸出函數(shù)波形為（ B ）。4、編碼電路和譯碼電路中，（ A ）電路的輸出是二進制代碼。（A）編碼 （B）譯碼 （C）編碼和譯碼 5、在邏輯功能上，具有約束條件的觸發(fā)器，只有（ A ）。（A）RS （B）JK （C）D二、簡單計算題1、用邏輯代數(shù)運算法則化簡1)2)2、應用卡諾圖化簡1)解：由表達式畫出卡諾圖畫出包圍圈合并最小項，得簡化與-或

2、表達式: 2)解：由表達式畫出卡諾圖畫出包圍圈合并最小項，得簡化與-或表達式: 3、分析下圖的邏輯功能。&11BAY& 解：由圖可得出表達式：化簡列出真值表如圖：分析結(jié)論：輸入相同輸出為1，輸入相異輸出為0，此為同或邏輯運算。4、設計一個A、B、C三人表決電路。當表決某個提案時，多數(shù)人同意，則提案通過，但A具有決定權(quán)。試列出狀態(tài)表，寫出表達式，并用與非門構(gòu)成邏輯電路實現(xiàn)此評判規(guī)定。解：設 A、B、C 同意提案時取值為 1，不同意時取值為 0；Y 表示表決結(jié)果，提案通過則取值為 1，否則取值為 0。由提議可得真值表如右圖由真值表畫出卡諾圖：得輸出函數(shù)為 ：化簡輸出函數(shù)為與非形式：5、用3線8線譯碼器和與非門設計一個一位二進制全減器邏輯電路。利用3線8線譯碼器74LS138和與非門設計CO：向高位的錯位；Y：兩位數(shù)的差；CI：來自低位的錯位其邏輯電路圖：6、已知時鐘脈沖信號CP及輸入信號A、B的波形，畫出J端口的波形和輸出端Q的波形，初始狀態(tài)為0。由圖可知：，AB同為1時,其他狀態(tài)都為0。由此可畫出J的波形圖。K始終為1，J=1時每輸入一個時鐘脈沖下降沿時，觸發(fā)器向相反的狀態(tài)翻轉(zhuǎn)一次；且知初始狀態(tài)為0，由此可畫出Q的波形圖。7、試用74LS160構(gòu)成七進制計數(shù)器。用 “160” 的后七

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